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西工大计算机学院计算机数字逻辑实验报告，最近发现之前上传的部分资源下载，这里给出实验四的报告供同学们参考，报告中给出实验截图还有相关设计，供各位同学参考下面给出部分的实验内容：掌握可综合Verilog语言进行状态机设计及测试验证； 2．学习如何在FPGA进行设计实现。安装开发工具ModelSim、Quartus的PC机、Altera DEII-115实验箱 1．跑马灯设计及FPGA实现（run.v） 2．有限状态机设计（教材Figure 6.86） 1.Quatusll使用流程 Quatusll的使用我们需要完成的是前面的七个步骤，分别是第一步:编码用文本编辑器正确编写源文件(本例run.v),并经modelsim仿真确认该电路设计正确. 第二步:新建工程新建工程New project (注意工程名和设计文件的module名保持一致),选择和开发板一致的FPGA器件型号(本课程为Cyclone IV E系列EP4CE115F29C7) 第三步:添加文件 Add to project,将全部源文件 (本例run.v)添加到工程中第四步:编译 Start

2022-11-21 18:15:47 972KB 西工大 数字逻辑 verilog 仿真

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西北工业大学数字逻辑实验一.docx

文件包含博主第一次数字逻辑实验的完整报告

2022-11-09 15:36:09 645KB 数字逻辑 verilog仿真

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I2C verilog仿真实现

I2C verilog 仿真实现仿真功能实现

2022-08-09 20:19:11 5KB I2C verilog 仿真实现

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ddr verilog仿真模型

micron 256Mb ddr仿真模型，支持modelsim，VCS，ncverilog仿真

2022-03-11 17:41:23 23KB ddr verilog

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SPI verilog仿真实现

SPI verilog仿真实现仿真功能实现

2022-02-25 17:14:42 3KB SPI verilog 仿真实现

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cordic算法实现

网络下载的Cordic算法实现资料，内部包含对Cordic算法的详细说明文档，verilog实现以及仿真，matlab实现，帮助你快速掌握Cordic算法

2021-12-17 19:20:08 2.75MB cordic算法 verilog仿真 matlab实现

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Cadence NC_verilog仿真

NC可用于数模混合仿真，即用verilog语言给画的电路图添加输入激励信号，然后查看输出信号，以验证电路是否正确。。

2021-12-03 09:02:19 506KB Cadence NC verilog 仿真

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bmp图片输入输出verilog仿真

将bmp图片模拟视频输入输出verilog仿真，在安装好modelsim的情况下，可直接运行sim文件夹下的.bat文件进行仿真。

2021-11-19 10:10:37 5.08MB bmp图片 verilog modelsim 仿真

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如何编写testbench的总结(Verilog)

网上找来编写testbench的一些总结，对初学者非常有用(基于verilog)

2021-11-01 00:56:36 56KB testbench FPGA verilog 仿真

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GPS的CA码设计与相关verilog程序

该部分程序用Verilog语言编写，主要用来生成GPS的CA码，并对CA做相关，同时附有仿真测试文件，完成空间通信系统相关课程的仿真实验

2021-10-28 15:43:39 3.47MB CA码 Verilog仿真 CA码相关

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