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modelsim时序仿真实例.zip
此工程基于XC7A100T(Artix7)工程,软件版本ISE14.7,仿真工具是modelsim_SE 10.4c,整个工程自己所写,不明白的可以去我的博客去看。
2023-01-10 18:21:53
1.4MB
modelsim仿真
IP核仿真
时序仿真
后仿真
1
FPGA之altera浮点IP核的仿真使用
近期的项 目要使用到整型数据转浮点型数据,将16位的整数转换为单精度浮点数(32bit)。Quartus II软件中也给我们免费提供了专用的浮点转换IP,因此就直接使用该IP核来进行设计。
2022-03-09 11:18:53
62KB
软件开发
FPGA
altera浮点IP核
仿真
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