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verilog eda 秒表
verilog eda 秒表1)熟悉EDA环境下的复杂逻辑模块的设计方法、设计过程及其注意事项; 2)学习EDA软件Quartus-II的使用; 3)学习硬件描述语言VHDL/Verilog HDL并进行编程; 4)学习秒表功能设计和LCD显示的基本原理、控制流程
2022-06-15 14:31:54
26KB
秒表
1
基于VHDL语言的
EDA秒表
作业设计
基于VHDL语言的
EDA秒表
作业设计,包括分频、秒表主体和数码管显示译码器,附有工程文件和管脚信息(EDA大作业西电02105143)
2021-10-27 17:55:57
423KB
VHDL语言
EDA秒表
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