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基于FPGA的FIR数字滤波器设计实现
本设计是一个基于Altera Cycone Ⅳ系列的FPGA芯片实现一个
37阶
FIR数字滤波器,其中采样频率为13.5MHz,截止频率0.23MHz,窗口函数采用海明窗,算法为分布式算法。包含源程序及仿真文件,程序可直接用于板间调试
2022-12-28 13:19:59
15.79MB
FPGA
FIR滤波器
37阶
分布式算法
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