设计一个篮球比赛用24秒计时器,要求计时器具有以下基本功能: 1, 计时采用倒计时方式,计时精度为十分之一秒; 2, 用三位数码管显示计时时间; 3, 可用开关(或按钮)实现计时器的24秒倒计时的起动、暂停/恢复计时和清零控制; 提示:所需要的0.1秒计数脉冲信号可由1KHz标准时钟信号分频产生。 有Multisim仿真文件及电路操作方法
2024-06-16 21:21:01 499KB Multisim 电子技术 电工技术
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一、(1)实现计数式数字频率计和测周式数字频率计的功能; (2)静态 6 位 LED 数码管显示 8 位数字,分两屏显示,由按键SHIFT切换; (3) 测量频率:1Hz~99.999999MHz。 二、(1)实现交通灯信号灯自动控制循环功能; (2)静态 6 位七段 LED 显示器的最左 2 位和最右 2 位分别显示主道和次道当前状态所剩余时间; (3)用 LEDR0-LEDR9 的不同点亮组合表示道路四种通行状态; (4) 黄灯亮时,发出声响,进行报警提示。用 500Hz 的音频信号来驱动耳机,并采用间歇方式发出报警音,即以 1 秒为周期,前 0.5 秒发音、后 0.5 秒静音,最后一声报警音则输出 1kHz 音频信号。
2024-03-04 17:03:28 23.66MB 数字逻辑电路设计
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侯伯亭版VHDL语言经典教程《VHDL硬件描述语言与数字逻辑电路设计(第三版)》
2023-09-07 15:39:10 24.9MB VHDL 数字逻辑电路
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本文设计了一套基于DSP的阵列声波信号采集与处理系统,此系统将作为正在研制的阵列声波测井仪中的一部分,应用于油田勘探中。
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logisim安装包,来源于github,资源纯正,支持中文,需要的快来下载吧
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数值逻辑电路设计课件,送给大家分享一下,个人感觉还不错。
2022-06-04 22:21:38 7.04MB 数字电路
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基于QuartusⅡ的数字逻辑电路设计技术基础 常见组合逻辑电路 时序逻辑电路的分析与设计
2022-05-18 11:46:41 23.05MB Quartus Verilog EDA
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VHDL硬件描述语言与数字逻辑电路设计-侯伯亨.rar VHDL硬件描述语言与数字逻辑电路设计-侯伯亨.rar VHDL硬件描述语言与数字逻辑电路设计-侯伯亨.rar
2022-05-08 11:48:33 16.9MB VHDL 数字逻辑电路设计 侯伯亨
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大数据-算法-高速耗单轨电流模逻辑电路设计术.pdf
2022-05-05 09:07:29 3.58MB 文档资料 big data 算法
课程设计要求 1、设计平台:quartus II+HH-SOPC-EP1C12 EDA/SOPC实验开发平台 2、设计方法:利用VHDL代码和/或原理图方法,采用层次化的方法进行设计(至少二层结构)。(功能分解) 3、结果验证:在实验开发平台上下载,验证设计的正确性,模块也需要仿真验证,给出仿真波形。 4、设计报告: A4纸打印,统一封面,封面格式见附件,简单装订。 课程设计题目 题目:多功能数字钟的设计与实现 1.能进行正常的时、分、秒计时,分别用6个七段数码管动态扫描显示时、分、秒。时时-分分-秒秒 2.利用按键开关快速调整时间(校准):时、分 3.通过按键开关设定闹铃时间,到了设定时间发出闹铃提示音,提示音长度为1分钟 4.通过按键开关设定倒计时的时间,通过开关启动/暂停倒计时,倒计时为0时发出提示音,提示音长度为1分钟 5.整点报时: 在59分50、52、54、56、58秒时按500Hz频率报时 在59分60秒时用1KHz的频率作最后一声整点报时
2022-02-09 09:05:42 588KB 硬件 VHDL
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