该模块为具有 1k 像素和 2 抽头的 DALSA Spyder 3 相机（型号 S3-20-01k40）提供 Camera Link 像素流解码。 它旨在使用 HDL Coder 生成代码，并在 Artix 7 FPGA 上使用 Xilinx Vivado 进行了测试。 该块以一个行周期的延迟输出相机行。 这是因为像素没有按顺序到达并且必须被缓冲。 line_valid 输出上的高电平表示有效行数据。

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