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《
系统硬件综合设计
》报告,cpu课设
1. 设计并实现一个多周期流水 MIPS32 CPU; 2、五段流水、可以处理冲突; 3、实现 MIPS 指令集的三种类型的指令若干条; 4、使用 modelsim-verilog 仿真测试
2021-06-29 15:21:29
3.53MB
cpu
电脑硬件
仿真器
1
合肥工业大学
系统硬件综合设计
,计算机组成原理CPU课设,多周期,modelsim
设计一个支持以下 28 条指令的包含取指、译码(取操作数)、执行、访存、 写回五个工作周期的五级流水多周期 CPU。能够处理数据相关的冲突,能够处理 分支延迟。
2021-06-22 09:33:56
246KB
mips
cpu
仿真器
1
合肥工业大学
系统硬件综合设计
.zip
合肥工业大学
系统硬件综合设计
计算机组成原理 含源代码 带注释
2021-05-02 18:00:12
776KB
计算机组成原理
系统硬件综合设计
合肥工业大学
1
MIPS五级流水线CPU(全部注释)
系统硬件综合设计
设计并实现一个多周期和流水CPU。 1.若干段流水、可以处理冲突。 2.三种类型的指令(R类,I类,J类指令)若干条。 3.CPU指令集(MIPS、ARM、RISC-V等均可)不限
2021-04-29 01:36:31
208KB
系统硬件综合设计
MIPS
流水线
CPU
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