摘 要：结合一个2．4 GHz CMOS低噪声放大器(LNA)电路，介绍如何利用Cadence软件系列中的IC 5．1．41完成CMOS低噪声放大器设计。首先给出CMOS低噪声放大器设计的电路参数计算方法，然后结合计算结果，利用Cadence软件进行电路的原理图仿真，并完成了电路版图设计以及后仿真。仿真结果表明，电路的输入／输出均得到较好的匹配。由于寄生参数，使得电路的噪声性能有约3 dB的降低。对利用Cadence软件完成CMOS射频集成电路设计，特别是低噪声放大器设计有较好的参考价值。 　　0 引 言 　　Cadence Design Systems Inc．是全球最大的电子设计技术、