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数字上下变频
FPGA 设计的详细介绍资料(中文版)
该设计主要负责实现基于GSM 标准的多载波数字下变频(DDC)和数字上变频(DUC),DDC 接收数字中频信号,输出数据通过CPRI接口传输给数字基带进行处理,数字基带通过CPRI就口把数据传输给DUC模块,把基带信号频谱搬移到数字中频,输出给DA。 本文描述DDC & DUC 的逻辑设计的详细说明,定义各个模块所需要完成的功能,各个模块的接口,及用户需要配置的各个寄存器进行说明。 该参考设计的目标器件是:LFE2M100E-7F900CES。
2021-11-13 16:48:18
402KB
DUC
DDC
数字变频
FPGA
1
赛灵思给出的LTE中
数字上下变频
CFR和DPD解决方案-Xilinx-LTE-DUC-DDC-PC-CFR-and-DPD.pdf
赛灵思给出的LTE中
数字上下变频
CFR和DPD解决方案-Xilinx-LTE-DUC-DDC-PC-CFR-and-DPD
2021-07-15 11:31:26
933KB
Xilinx
LTE
DDC
数字上下变频
1
基于FPGA的
数字上下变频
器的研究与实现
非常好的
数字上下变频
资料。从原理到FPGA实现,比较实践派。
2021-06-18 08:38:49
4.46MB
FPGA
DDC
DUC
上变频
1
混频(
数字上下变频
)原理及FPGA实现.rar
一个快速搭建的混频模块,可以支持iq复信号的上变频,包含有数控振荡器NCO/复数乘法模块,将输入信号的频谱搬移到指定的频率点位置
2021-03-20 12:44:03
12.74MB
数字上变频
混频
FPGA
Verilog
1
一个关于DPSK收发的完整FPGA工程代码,包括调制,解调,
数字上下变频
,滤波器等
一个关于DPSK收发的完整FPGA工程代码,包括调制,解调,
数字上下变频
,滤波器等
2019-12-21 19:43:28
12.13MB
DPSK
1
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