相关资料： 基于FPGA的音乐硬件演奏电路设计与实现（一）     　　3 系统的方案实现 　　3.1 各模块仿真及描述 　　notetabs作为音符rom的地址发生器，此模块中设置了一个8位2进制计数器，频率为4hz,即为4个音符一秒时间四四拍的4分音符。notetabs计数器计数器按4hz时钟频率做加法计数，当stop为高电平时停止加法运算，而当change可设置rom中数据的跳转，rom通过toneindex[30]端口输向tonetaba模块。乐曲就演奏起来了。 　　由图6 sperkera仿真波形可以看出，当clk输入时钟频率为12mhz时，输出端信号clk输出的频

该文在EDA 开发平台上，利用VHDL 语言设计数控分频器电路，采用可编程逻辑器件CPLD/FPGA,经过整体分析、模块化分析、整体与模块的仿真分析三个步骤，以乐曲《梁祝》为例，使硬件实现了整体复位、按键选择演奏方式、循环演奏以及数码管显示乐谱的功能。系统能自动从头开始循环播放，也可随时起停、、按键选择播放、循环播放播放中切换歌曲以及发光二极管动态显示播放的音符。