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基于FPGA的
北斗导航电文
译码器的研究与设计
通过对
北斗导航电文
BCH纠错编译码方式的深入理解和研究,提出了一种基于并行数据处理的BCH译码器的设计方案。该方案利用FPGA对BCH电文进行并行处理,在一个时钟周期内实现电文译码,提高了BCH解码模块的译码效率;同时给出了系统各个模块的Modelsim仿真结果与分析,验证了设计的可行性。本设计对提高接收机的基带数据处理性能有一定的参考和指导意义。
2023-02-13 20:39:54
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北斗导航电文
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北斗导航电文
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2021-02-20 19:30:52
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