的可扩展多通道同步采样数据采集系统(DAS)的布局考虑 电路功能与优势 在电力线路测量和保护系统中，需要对多相输配电网络的大量电流和电压通道进行同步采样。这些应用中， 通道数量从6 个到64个以上不等。AD76068通道数据采集系统(DAS)集成16 位双极性同步采样SAR ADC 和片内过压保护功能，可大大简化信号调理电路，并减少器件数量、电路板面积和测量保护板的成本。高 集成度使得每个 AD7606 只需 9 个低值陶瓷去耦电容就能工作。 在测量和保护系统中，为了保持多相电力线网络的电流和电压通道之间的相位信息，必须具备同步采样能 力。AD7606 具有宽动态范围，是捕获欠压/欠流和过压/过流状况的理想器件。输入电压范围可以通过引脚 编程设置为±5 V 或±10 V。 此电路笔记详细介绍针对采用多个 AD7606 器件应用而推荐的印刷电路板(PCB)布局。该布局在通道间匹 配和器件间匹配方面进行了优化，有助于简化高通道数系统的校准程序。当通道间匹配非常重要时，此电 路可以使用 2.5 V 内部基准电压源 AD7606；而对于要求出色绝对精度的高通道数应用，此电路可以使用 外部精密基准电压源 ADR421，它具有高精度（B 级：最大值±1 mV）、低漂移（B 级：最大值 3 ppm/°C）、 低噪声（典型值 1.75 μV p-p，0.1 Hz 至 10 Hz）等特性。低噪声及出色的稳定性和精度特性使得 ADR421 非常适合高精度转换应用。这两个器件相结合，能够实现业界前所未有的集成度、通道密度和精度。 回到顶部 电路描述 AD7606 是一款集成式 8 通道数据采集系统，片内集成输入放大器、过压保护电路、二阶模拟抗混叠滤波 器、模拟多路复用器、16 位 200 kSPS SAR ADC 和一个数字滤波器。图 1 所示电路包括两个 AD7606 器 件，可以配置为使用 2.5 V 内部基准电压源或 2.5 V 外部基准电压源 ADR421。如果 REF SELECT 引脚接 逻辑高电平，则选择内部基准电压源。如果 REF SELECT 引脚接逻辑低电平，则选择外部基准电压源。 电源要求如下：AVCC = 5 V, VDRIVE = 2.3 V 至 5 V（取决于外部逻辑接口要求）。 本电路笔记描述一个评估板的布局和性能，其中内置两个 AD7606，构成一个 16 通道数据采集系统。欲浏 览完整的 16 通道 DAS PC 板文档，请访问：www.analog.com/CN0148_PCB_Documentation 为实现良好的通道间匹配和器件间匹配，模拟输入通道和器件去耦的对称布局非常重要。所示数据支持利 用图 1 所示 16 通道 ADC 实现的匹配性能。 图 . . . 1. 采用两个 AD7606 88 通道 DAS 的 16 通道、16 位数据采集系统（原理示意图，未显示所有连接。 对于通道间和器件间匹配测试，器件之间的具体连接参见正文） 放大 16 通道 DAS 的双路 AD7606 板布局 在内置多个 AD7606 器件的系统中，为确保器件之间的性能匹配良好，这些器件必须采用对称布局。图 2 显示采用两个 AD7606 器件的布局。 图 . . . 2. 采用两个 AD7606 的 16 通道 DAS 的 PCB 布局 放大 AVCC电压平面沿两个器件的右侧布设，VDRIVE 电源走线沿两个 AD7606 器件的左侧布设。基准电压芯片 ADR421 位于两个 AD7606 器件之间，基准电压走线向上布设到 U2 的引脚 42，向下布设到 U1 的引脚 42。 使用实心接地层。这些对称布局原则适用于含有两个以上 AD7606 器件的系统。AD7606 器件可以沿南北 方向放置，基准电压位于器件的中间，基准电压走线则沿南北方向布设，类似于图 2。 良好的去耦也很重要，以便降低 AD7606 的电源阻抗，及其电源尖峰幅度。去耦电容应靠近（理想情况是 紧靠）这些引脚及其对应接地引脚放置。 REFIN/REFOUT 引脚和 REFCAPA、REFCAPB 引脚的去耦电容是攸关性能的重要电容，应尽可能靠近相 应的 AD7606 引脚。可能的话，应将这些电容放在电路板上与 AD7606 器件相同的一侧。图 3 显示 AD7606 电路板顶层的建议去耦配置。所示的四个陶瓷电容是 REFIN/REFOUT 引脚、REGCAP 引脚、REFCAPA 引脚和 REFCAPB 引脚的去耦电容。这些电容沿南北方向放置，以便尽可能靠近相应的引脚。 图 . . . 3. 顶层去耦，显示了两个 REFCAPA 引脚、REFIN/REFOUT 引脚和 REFCAPA/B 引脚的去耦电 容 放大 图 4 显示底层去耦配置，它用于四个 AVCC 引脚和 VDRIVE 引脚的去耦。使用多个过孔将引脚与其相应的 去耦电容相连。AD7606 器件周围去耦电容的对称布局有利于器件间的性能匹配。多个过孔用来将电容焊 盘和引脚焊盘接地及接到电压平面和基准电压走线。 图 . . . 4. 底层去耦，显示了四个 AVCC 引脚和 VDRIVE 引脚的去耦电容 放大 16 通道系统的通道间匹配 在高通道数系统中，良好的通道间和器件间性能匹配可以大大简化校准程序。AD7606 器件、模拟输入通 道和去耦电容的对称布局有助于多个器件之间的性能匹配。使用公共系统基准电压将能进一步增强系统的 匹配性能。图 5 显示所有输入接地时，用于测量板上 16 个通道之间性能匹配的电路配置。还有最多 7 个 码的分布直方图，各通道直方图的中心为码 0，如图 6 所示。 图 . . . 5. 用于测试 16 通道系统通道间匹配的电路示意图，该系统采用两个 AD7606 和外部基准电压源 ADR421，所有输入接地 放大 图 . . . 6. 图 55 所示电路的直方图，显示了使用外部基准电压源 ADR421 的 16 通道系统的通道间匹配性能 放大 AD7606 内部基准电压源用作系统基准电压源 AD7606 内置一个 2.5 V 基准电压源，经过内部放大，它可以为 AD7606 ADC 提供约 4.5 V 的缓冲基准电 压。在通道间和器件间匹配性能至关重要的高通道数应用中，可以用一个 AD7606 的内部基准电压源为另 一个 AD7606 器件提供基准电压。在此配置中，U1 配置为在内部基准电压下工作，如图 7 所示。 图 . . . 7. 用于测试一个 AD7606 通道间匹配的电路示意图，使用 U1 内部基准电压源 放大 AD7606 U2 器件可配置为在外部基准电压源模式下工作。U1 REFIN/RFOUT 引脚提供的 2.5 V 基准电压 路由至 U2 的 REFIN/REFOUT 引脚。一个 10 μF 去耦电容位于 AD7606 器件的 REFIN/REFOUT 引脚。 在 AD7606 U1 和 U2 上，REFCAPA 和 REFCAPB 引脚短接在一起，并通过一个 10 μF 陶瓷电容去耦至 GND。 两个 AD7606 器件均以 200 kSPS 的采样速率工作，一个 7.5 V 直流信号施加于 U1 的 V1 和 V2，如图 7 所示。码的直方图如图 8 所示。在同一器件的通道之间，平均输出码相差 1.2 个码。板上的所有 16 个通道 以 200 kSPS 速率进行转换。 图 . . . 8. 图 77 所示电路的直方图 放大 7.5 V 信号施加于 U1 的 V1 和 U2 的 V1，板上的所有 16 个通道以 200 kSPS 速率工作，如图 9 的配置电 路示意图所示。码的直方图如图 10 所示。在不同器件的 V1 通道之间，平均输出码相差 1.4 个码。 图 . . . 9. 用于测试两个 AD7606 之间器件间匹配的电路示意图，U1 内部基准电压源用作系统基准电压源 放大 图 10. 图 99 所示电路的直方图 放大 将一个 AD7606 的内部基准电压源用作系统基准电压源时，以上直方图显示，一个 AD7606 器件的通道之 间以及多个器件的通道之间都具有非常好的匹配性能。 绝对精度 除了通道间匹配和器件间匹配外，如果 ADC 转换结果的绝对精度也非常重要，则应使用外部小容差、低漂 移基准电压源作为系统基准电压源。在该电路中，ADR421 2.5 V 基准电压源用作系统基准电压源。 施加于 AD7606 器件的基准电压会影响 ADC 输出码： 实际理想码的值会因温度而不同，具体取决于系统基准电压源的温度系数特性。在绝对精度非常重要的应 用中，或者在希望避免通过复杂的温度校准程序实现绝对精度和通道匹配的应用中，应当使用 ADR421 等 小容差、低漂移 2.5 V 基准电压源作为 AD7606 器件的系统基准电压源。 7.5 V 直流电压施加于 U1 的输入（V1 和 V2），如图 11 的电路所示，并使用外部基准电压源。U1 的两个 通道的码直方图如图 12 所示。两个通道的码直方图平均值相差 0.9 LSB。 图 11. 用于测试一个 AD7607 通道间匹配的电路示意图，使用外部基准电压源 放大 图 12. 图 11 所示电路的直方图 放大 在用于测试器件间匹配的图 13 所示电路中，7.5 V 直流信号施加于 U1 和 U2 AD7606 器件的 V1 通道，并 使用外部基准电压源。两个 AD7606 器件的两个 V1 通道的码直方图如图 14 所示。板上的所有 16 个通道 以 200 kSPS 吞吐速率工作。U1 和 U2 的 V1 通道之间的码直方图平均值相差 0.6 LSB。 图 13. 用于测试两个 AD7606 器件间匹配的电路示意图，使用外部基准电压源 放大 图 14. 图 13 所示电路的直方图 放大 以上直方图显示，采用 ADR421 外部系统基准电压源时，一个 AD7606 器件的直方图平均值间匹配和多个 AD7606 器件的直方图平均值间匹配均小于 1 LSB。 结论 本布局能够确保通过一个 AD7606 实现通道间良好匹配性能，并且同一 PC 板上的多个 AD7606 之间也具 有良好的器件间匹配性能。AD7606 器件的对称布局，特别是去耦电容将有助于实现良好的通道间匹配和 器件间匹配。在高通道数系统中，良好的通道间和器件间性能匹配意味着校准程序得以简化。 回到顶部 常见变化 AD7606 是一款 8 通道 DAS，还可以使用 AD7606-6（6 通道 DAS）和 AD7606-4（4 通道 DAS）。AD7607 是 AD7606 的 14 位版本。其它基准电压源可以利用基准电压源选型和评估工具进行选择。 回到顶部 此电路中所用产品:: 产品 描述 AD7606 8 通道 DAS，内置 16 位、双极性、同步采样 ADC AD7606-4 8/6/4 通道 DAS，内置 16 位、双极性、同步采样 ADC AD7606-6 8/6/4 通道 DAS，内置 16 位、双极性、同步采样 ADC ADR421 超精密、低噪声、2.500 V XFET®基准电压源

24位BMP图片转565格式16位数组C文件代码，生成的代码用于嵌入式程序代码中图片文件显示，BMP图片以数组的形式保存并读取

适用于HLK-806和HLK801的ST7789 16位的并口驱动

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ESP8266 微芯片 MCP23S17 驱动程序 支持 Microchip MCP23S17 SPI I/O 扩展器。 允许通过 SPI 总线使用多达 128 个额外的 GPIO 引脚。 在一条 SPI 总线上支持多达 8 个 MCP23S17（16 个 GPIO）芯片，总共多达 128 个 GPIO 引脚。 当前不支持在一条总线上混合 MCP23S08 和 MCP23S17 芯片。 需要我的 SPI 驱动程序： :

效验和（checksum)  原理：把要发送的数据看成二进制整数序列，并计算他们的和。若数据字节长度为奇数，则在数据尾部补一个字节的0以凑成偶数。  例子：16位效验和计算，下图表明一个小的字符串的16位效验和的计算。为了计算效验和，发送计算机把每对字符当成16位整数处理并计算效验和。如果效验和大于16位，那么把进位(carry)一起加到最后的效验和中。 H e l l o w o r l d . 4865 6C6C 6F20 776F 726C 642E 4865+6C6C+6F20+776F+726C+642E+carry=71FC