《数字电路与数字逻辑》复习共计30页，内容包含了数制码制、逻辑代数、逻辑门电路、组合逻辑电路、触发器、时序逻辑、数模及模数转换器这几个大类。

proteus8.6：译码器74LS138和门电路设计一个全加器 全加器英语名称为full-adder，是用门电路实现两个二进制数相加并求出和的组合线路，称为一位全加器。一位全加器可以处理低位进位，并输出本位加法进位。多个一位全加器进行级联可以得到多位全加器。

电源变压器与一般的器件一样，应急工作时可以将其多个变压器在一定条件下进行串并联使用，如市售的电源变压器是完全可以满足要求。变压器功率满足要求时，而没有合适的电压，可以将两个或多个变压器串联使用；在电压满足的条件下，而变压器功率不够时，又可以将两个或多个变压器并联使用，以满足电路供电要求。电源变压器是由电感线圈构成的，所以完全遵循电感器的运算规则，即可把电源变压器初级串联，也可在输出的次级串联，现将四种情况分别介绍如下。 　　1.电源变压器的初级串联 　　在变压器计算式中有一个常数N称为匝数比，它是初级匝数与次级匝数之比，初次级电压比关系为N,而初次级电流比关系为1/N.例如：两个初级为22

利用SPICE软件设计了四输入端CMOS与或非门电路

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门电路逻辑功能及测试

TI Logic Gate 1.IntLib

使用两片74LS161和门电路设计一个六十进制计数器。 （1） 画出连线图，输出用七段数码管7SEG-BCD显示出来。 （2）74LS161的CP脉冲由信号源中的DCLOCK提供，要求七段数码管的显示将从00→01→02→03→04→05→06→07→08→09→10→11→12→┄→57→58→59按十进制数循环变化。 使用两片74LS161和门电路设计一个六十进制计数器。 （1） 画出连线图，输出用七段数码管7SEG-BCD显示出来。 （2）74LS161的CP脉冲由信号源中的DCLOCK提供，要求七段数码管的显示将从00→01→02→03→04→05→06→07→08→09→10→11→12→┄→57→58→59按十进制数循环变化。

主要内容 1. CMOS门电路 2. CMOS RAM单元及阵列 3. CMOS D触发器 4. CMOS放大器 5. 双极集成电路

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