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基于verilog的MIPS32
单周期CPU
设计与实现.zip
基于vivado软件,使用verilog语言,较好地实现MIPS32的20条指令。包含测试代码和CPU实现代码。 实现的具体功能如下: 1.设计的CPU能够执行20条整数指令,每条指令的编码长度均为32位; 2.指令类型有:计算类型、访问存储器类型、条件转移类型和无条件转移类型等; 3.实现CPU的封装处理。 具体设计思路参见:https://blog.csdn.net/qq_45288566/article/details/103656372
2021-06-01 08:47:31
10.75MB
verilog
vavido
MIPS32
1
single_cycle_cpu,
单周期cpu
单周期CPU
,single_cycle_cpu,南京大学计算机系计算机组成原理实验-Single-cycle CPU, single_cycle_cpu, Nanjing University Computer Science Department of Computer Composition Principle Experiment
2021-05-31 09:55:34
1.72MB
单周期cpu
single_cycle_cpu
1
一个模拟
单周期cpu
的mips编译器
这是一个利用类模拟cpu各部分工作的MIPS编译器,附实验报告
2021-05-30 16:24:11
13.45MB
c++
MIPS
1
《计算机组成原理》实验报告-
单周期CPU
设计全过程
单周期CPU
设计全过程: 组成原理实验课,包含十六条指令实现,完整的代码以及详细的实验报告,是本人实验课的作业。用verilog HDL语言或者VHDL语言来编写,实现
单周期CPU
的设计。 用Verilog HDL语言编写MIPS32
单周期CPU
程序 (1)理解MIPS常用的指令系统并掌握
单周期CPU
的工作原理与逻辑功能实现。 (2)通过对
单周期CPU
的运行状况进行观察和分析,进一步加深理解。
2021-05-29 16:52:38
2.37MB
单周期CPU设计
计算机组成原理
MIPS32
Verilog
1
单周期CPU
实现(verilog语言,使用vivado软件)
这是计算机组成原理课设,基于verilog实现的
单周期CPU
代码,实现了add, addu, addi, addiu, sub, slt, and, or, xor, beq, j, sw, lw, lui,andi,addu,ori,xori,共18条指令,能够运行简单的冒泡排序。内含实验报告。
2021-05-27 22:02:39
717KB
verilog
单周期CPU
冒泡排序
计算机组成原理
单周期24条指令.zip
单周期CPU
设计实验我们首先设计一个硬布线控制器,利用硬布线控制器的设计原理,来实现一个支持24条指令的MIPS
单周期CPU
。利用在运算器实验和存储系统实验中构建的运算器、寄存器文件、存储系统等部件以及Logisim其他功能部件,来构建一个32位MIPS CPU单周期数据通路。
2021-05-21 18:57:09
471KB
计算机组成原理
华中科技大学
单周期cpu设计24条指令
1
18条指令
单周期CPU
设计
ZJU计算机组成课程作业,内含各部件代码,支持18条指令,包括slt,lui,slr,sll,jr,jal等指令。
2021-05-21 18:17:39
9.72MB
计算机组成
1
MIPS
单周期CPU
-组成原理实验_16位
单周期cpu
28条指令原理图,24条
单周期cpu
设计
使用logisim布线完成的MIPS
单周期CPU
,可支持28条指令。跑马灯的代码已经装入了寄存器,可以直接开启时钟运行。
2021-05-13 09:04:28
1005KB
MIPS
logisim
计算机硬件系统设计logism 单周期MIPS CPU
此文件是计算机硬件系统设计中的单周期MIPS CPU设计,完成了8种指令的设计,实现了降序排列的功能。
2021-05-07 13:45:31
164KB
logisim
计算机组成原理
计算机硬件系统设计
单周期CPU
1
单周期CPU
模型机的设计与实现 SingleCycleCPU.rar
verilog实现的机器字长16位的单周期处理器设计,
单周期CPU
模型机的设计与实现。十几条指令,带文档和接口,设计流程的说明,非常详细。自己写的。有扩展需求还可以私信我
2021-05-03 16:33:35
1.5MB
计算机组成原理
计算机组成与体系结构
verilog
fpga
1
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