FPGA(EP4CE6)控制步进电机实验Verilog逻辑源码Quartus工程文件+文档资料, module STEP_MOTO_V1_0 ( //input input sys_clk , input [3:0] key , output reg mot_out_a , output reg mot_out_b , output reg mot_out_c , output reg mot_out_d ); //reg define reg [8-1:0] counter ; reg [8-1:0] count ; reg [25:0] clk_cnt ; reg [ 2:0] step_cnt ; //wire wire step_en ; //wire define //parameter define assign sys_rst_n = 1'b1 ; // gen a time counter , 5500000 * 20ns always @(posedge sys_clk or negedge sys_rst_n) begin if (sys_rst_n ==1'b0) clk_cnt <= 26'b0; else if ( clk_cnt == 26'd500000 ) clk_cnt <= 26'b0; else clk_cnt <= clk_cnt + 26'b1; end // step enable is active 5500000 * 20ns assign step_en = ( clk_cnt == 26'b0 ) ? 1:0 ; always @(posedge step_en or negedge sys_rst_n) begin if (sys_rst_n ==1'b0) step_cnt <= 3'b0; else step_cnt <= step_cnt + 3'b1; end always @(posedge step_en or negedge sys_rst_n) begin if (sys_rst_n ==1'b0) begin mot_out_a <= 1'b0; mot_out_b <= 1'b0; mot_out_c <= 1'b0; mot_out_d <= 1'b0; end else if ( step_cnt == 0 ) begin mot_out_a <= 1'b0; // 6 mot_out_b <= 1'b0; mot_out_c <= 1'b0; mot_out_d <= 1'b1; end else if ( step_cnt == 1 ) begin mot_out_a <= 1'b0; mot_out_b <= 1'b0; mot_out_c <= 1'b1; mot_out_d <= 1'b1; end else if ( step_cnt == 2 ) begin mot_out_a <= 1'b0;

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ST电机库，控制台翻译，对新手学习 st电机库，有很大的帮助。

STM32F405单片机设计步进电机控制板ALTIUM设计硬件原理图+PCB+软件工程源码，硬件采用2层板设计，大小为78*95mm,包括完整的原理图和PCB文件，及DEMO软件源码。 硬件主要器件如下： Library Component Count : 22 Name Description ---------------------------------------------------------------------------------------------------- A4988_MODE AMS1117-3.3V BEEP CAP CAP2 Diode Diode2 FLASH HEADER2 HEADER3 HEADER4 HEADER5 HEADER7 Inductor Inductor LED RES SRA-RELAY STM32F405RGT6 ARM Cortex-M4 32b MCU+FPU, 210DMIP, 1024 kB Flash, 192+4 kB RAM, 51 I/Os, 64-pin LQFP, -40 to +85癈, Tray SW ULN2003 XL4015 XTAL 功能包括：1、4路42步进电机控制2、1路小步进电机控制3、2路继电器控制4、蜂鸣器，可以做为你的学习设计参考。