搜索【testbench ve】的结果

led实例的RTL和tb.rar

FPGA开发流程的示例，RTL代码和testbench文件。

2021-12-18 19:03:16 748B FPGA LED testbench

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Writing_Testbench.

一本非常好的关于Modelsim Testbench 的书籍很实用的

2021-12-18 13:26:28 5.69MB Modelsim 测试程序编写

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用VHDL语言的两种分频方法及testbench

使用VHDL语言的两种分频方法介绍及其modelsim的testbench。

2021-12-12 21:33:08 290KB VHDL 分频 testbench FPGA

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教你怎样编写verilog的testbench

众所周知，编写testbench对于用verilog编写程序是非常重要的，本文件可以帮您理解testbench的编写方法

2021-12-08 22:14:45 122KB verilog testbench

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串并转换VHDL代码(包括TESTBENCH)

本程序能将数码率为115.2K的串行输入序列转换为8个并行输出，在输出有效的时候可供后续电路使用该并行信号。

2021-11-27 23:00:59 6KB 串并转换 VHDL

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VHDL Verilog 实现三态门的源程序以及testbench代码

1）VHDL 语言下同步、异步三态门的实现和仿真； 2）VerilogHDL 语言下同步、异步三态门的实现和仿真；

2021-11-24 11:39:32 501KB VHDL 三态门

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perl在IC设计中的应用入门实例

本文档是一个小型的perl语言在ic验证方面的入门资料包，包含了perl软件，perl文本编辑器，一个Perl编写的自动生成testbench的详细教程。

2021-11-23 20:26:38 29.03MB perl verilog ic testbench

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如何编写verilog测试文件

介绍了verilog testbench的基本写法和一些技巧，对于初学者是很有帮助的。

2021-11-20 08:53:26 52KB verilog testbench 测试

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基于verilog HDL的FPGA工程，对m序列进行2psk调制解调，使用乘法器进行相干解调，包括了testbench文件，仿真视图，和测试报告。代码没有严格编写，仅供参考，仅支持quartus17.0版本，其他版本请重建IP核。

2021-11-16 20:55:20 49.45MB 2psk verilog quartus17.0

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proxmox-ve_6.2-1

2021-11-16 16:17:54 59B proxmox-ve_6.2p

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