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基于xilinx vivado 的DDR3 IP核扩展IP FDMA 的使用详解.pdf

本文介绍了基于Xilinx Vivado的DDR3 IP核扩展IP FDMA的使用详解。FDMA是一个定制的DMA控制器，基于AXI4总线协议。本文主要从IP的设置和使用两个方面进行了详细介绍，使读者能够更好地理解和应用该IP。通过使用FDMA IP，我们可以实现用FPGA代码直接控制DDR3存储器，从而提高系统性能。

2023-04-14 10:41:34 568KB

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xilinx axi_uartlite资料

用于zynq的嵌入式部分的基于axi的串口

2023-04-12 20:08:24 398KB zynq axi的串口

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Vivado暗黑主题配置文件

将vivado编辑器页面、原理图界面、xdc文件界面、tcl命令界面等修改为黑色背景，并设置每次打开vivado自动应用自定义黑色主题。

2023-04-11 19:26:43 69KB vivado fpga verilog xilinx

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DDR2 xilinx IP core 官方文档

xilinx的官方文档，在官方网站可以下到的。

2023-04-07 20:57:34 2.88MB DDR XILINX IP core

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02Kintex修炼秘籍-MIG DDR应用3缓存设计.pdf

节介绍 7 系列 FPGA 存储器接口解决方案核心架构，概述了核心模块和接口。图 4-1-1 所示的用户 FPGA 逻辑模块是需要连接到外部 DDR2 或 DDR3 SDRAM 的任何 FPGA 设计。用户 FPGA 逻辑通过用户界面连接到内存控制器。IPCORE 提供了一个用户 FPGA 逻辑示例。

2023-04-06 20:58:14 5.94MB mig xilinx vivado 参考设计

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u-boot image生成

这节介绍一下如何生成u-boot image文件，在SDK软件中点击Xilinx Tools→Create Boot Image工具即可生成，但是生成image文件需要首先集齐3个文件：u-boot.elf、system.bit和fsbl.elf。

2023-04-06 09:43:03 37KB u-boot Image xilinx 文章

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xilinx ise design suite 10.1

xilinx ise design suite 10.1 下过很多都不能用这是从别人那里拷过来的用起来还不错安装方法网上可查

2023-03-31 18:48:30 104KB xilinx ise design suite

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Xilinx 官方 8/10B 编码实现的 Verilog 代码

Xilinx 8B/10B Xilinx and its licensors make and you receive no warranties or conditions, express, implied, statutory or otherwise, and Xilinx specifically disclaims any implied warranties of merchantability

2023-03-31 13:29:10 7KB Xilinx 8B/10B 编码 HDMI

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xilinx ise 14.7 破解license

xilinx ise 14.7 破解,找了好久才找到的，xilinx ise 14.7 版本，好像用的不是很多，所以资源不好找,至于怎么加载license,简单，百度即可.

2023-03-30 10:20:34 672B xilinx ise 14.7 破解

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vivado xilinx IP license(含SRIO Jesd)

2018.3测试可用，各种IP超级齐全，测试了srio可用，Jesd等IP均显示正常，理论上所有版本应该都支持，大家下来看看。可以生成bit流，不用改系统时间，直接导入就行，基本包含全部常用的IP license。

2023-03-28 10:40:27 7KB xilinx srio license Jesd

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