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任意N位和M位的乘法器VHDL实现

我是2014级复旦的研究生。这是用VHDL语言设计的任意的M乘以N位的乘法器。设计中，被除数和乘数的位数是通过参数来设置的，可由你来修改。我已写好了testbench。可放心使用。

2019-12-21 19:42:12 166KB 任意N位和M位 乘法器 VHDL实现

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任意N位和M位的乘法器VHDL实现（代码）

我是2014级复旦的研究生。这是用VHDL语言设计的任意的M乘以N位的乘法器。设计中，被乘数和乘数的位数是通过参数来设置的，可由你来修改。我已写好了testbench。可放心使用。

2019-12-21 19:42:12 161KB 任意N位 M位 乘法器 VHDL实现

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fpga 8位乘法器 verilog HDL 源代码

fpga 8位乘法器 verilog HDL 源代码；带有tstbench文件

2019-12-21 19:27:00 4.4MB verilog HDL fpga

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16位乘法器VerilogHDL源代码

16位乘法器VerilogHDL源代码，适合于初学者

2019-12-21 19:21:14 7KB 16位 乘法器 Verilog HDL

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移位相加型8位乘法器

采用Verilog语言设计的移位相加型8位硬件乘法器小论文

2019-12-21 18:57:53 156KB Verilog 乘法器

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用移位加法器实现8位乘法器（分模块）

通过控制模块、数据选择模块、加法器模块、移位模块、锁存模块和上层实体实现，有详细注释

2019-12-21 18:52:19 323KB 8位乘法器 模块实现 移位加法器

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