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EDA实验报告_正弦信号发生器_序列检测器
EDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.docEDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.docEDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.doc
2021-06-26 01:06:14
702KB
FPGA
CPLD
EDA
VERILOG
VHDL
1
verilog HDL语言设计
介绍verilog语言,并例举大量实例,同时介绍相关的开发软件。
2021-06-05 19:00:52
10.75MB
verilog
vhdl
EDA
电子设计
1
FPGA/CPLD边练边学—快速入门Verilog/VHDL
特权的《FPGA/CPLD边练边学—快速入门Verilog/VHDL》,缺“第4章 Verilog与VHDL语法基础”。
2021-05-22 17:07:55
5.73MB
FPGA
CPLD
Verilog
特权
1
PS/2键盘解码
Verilog/VHDL
程序
PS/2键盘解码实验程序: CPLD通过PS/2接收键盘的数据,然后把接收到的大写字母A-Z的键值转换成相应的ASCII码,再通过串口传送给PC机。只要字母按键被按下,就能够在串口调试助手里显示相应的字母。 文件中包括Verilog和VHDL的两种语言的Quartus II程序,请您参考。
2021-05-21 08:17:00
382KB
Verilog
CPLD
FPGA
VHDL
1
FPGA矩阵键盘扫描
FPGA控制实现4x4矩阵键盘扫描,按下某按键对应在数码管上显示从0到F
2021-05-18 20:50:55
253KB
FPGA
矩阵键盘扫描
Verilog
VHDL
1
Verilog数字系统设计(夏宇闻) 第3版.zip
本压缩包主要是夏宇闻编写的Verilog数字系统设计,这是 第3版的课程资源的pdf版本,内容涵盖492页,带书签,字迹清晰,适合初学FPGA的人学习观看.
2021-05-06 18:47:17
103.87MB
Verilog
VHDL
fpga
1
CCT代码行数统计工具支持verilog,vhdl,c,c++,jave等主流语言,win10已经验证没问题
CCT代码行数统计工具支持verilog,vhdl,c,c++,jave等主流语言,
2021-04-26 20:25:29
1.69MB
代码规范
verilog
1
gvim高亮显示
verilog/vhdl
/system verilog 文件配置
gvim高亮显示
verilog/vhdl
/system verilog 文件,直接解压后替换自己目录下的.vim文件夹和.vimrc文件即可
2021-04-25 17:00:47
107KB
linux
vim
1
Uart串行控制系统-回环功能-verilog实现
南京邮电大学课程设计uart串行通信控制器代码实现,实现了带回环功能的uart协议的串行通信,分为接收发送两个模块。
2021-04-19 15:19:22
6KB
uart
南邮课程设计
verilog
vhdl
1
按键控制LED的亮灭
Verilog/VHDL
程序
用两个按键的不同组合来控制LED指示灯的状态: 1.没有手指触碰按键,LED灭; 2.手指按下左边按键,LED亮; 3.手指按下右边按键,LED亮; 4.手指同时按下按键,LED灭; 文件中包括Verilog和VHDL的两种语言的Quartus II程序,请您参考。
2021-03-31 20:06:07
309KB
VHDL
Verilog
CPLD
FPGA
1
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