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Verilo
g的数字钟的设计与开发
基于
Verilo
g的数字电子钟的设计与开发,代码是课程设计的时候写的。传到这里供大家研究。里面有原理图,实验报告等。
2021-06-01 20:02:28
116B
Verilo
数字电子钟
1
CRC-16(Modbus)并行计算
Verilo
g代码
CRC-16(Modbus)并行计算
Verilo
g代码,结果可在网页http://www.ip33.com/crc.html上进行计算对比
2021-05-27 16:27:14
3KB
CRC-16
Verilo
并行
Modbus
1
基于SOPC的数字电子时钟设计.rar
学校课设题目,采用quartus II与NIOS软件,硬件语言采用
Verilo
g。材料有课设报告,整个工程,可以软件上直接运行。 实现功能:1.显示部分:数码管显示,lcd显示,VGA大屏显示.2.数字电子时钟:时钟功能,倒计时功能,闹钟功能,时间精确1S。 验证平台:DE2-115.
2021-05-26 23:32:22
50.29MB
verilo
NIOS
II
电子时
1
PrimeTime使用说明(中文)
介绍了数字集成电路设计中静态时序分析(Static Timing Analysis)和形式验证(Formal Verification)的一般方法和流程。这两项技术提高了时序分析和验证的速度,在一定程度上缩短了数字电路设计的周期。本文使用Synopsys公司的PrimeTime 进行静态时序分析,用Formality 进行形式验证。由于它们都是基于Tcl(Tool Command Language)的工具,本文对Tcl 也作了简单的介绍。
2021-05-17 20:35:24
455KB
pt
primet
时序分析
Verilo
1
MLX90614驱动
MLX90614驱动程序,因该芯片在FPGA平台上还没有驱动,自己写了一个,已经调试通过,欢迎各位下载。
2021-05-15 18:02:04
12KB
Verilo
FPGA
1
BCD 码转7 段显示码的程序,通过外部开关控制数码管显示数字0-9
设计一个完整的组合逻辑电路,并用Quartus 进行综合,用Modelsim 进行仿真,并将综合 的结果下载到实验箱中,测试电路的正确性。 要求:设计一个BCD 码转7 段显示码的程序,通过外部开关控制数码管显示数字0-9,大 于9 时应该无显示。
2021-05-13 22:54:48
16.78MB
verilo
1
基于FPGA的AD9910的驱动程序
基于FPGA的AD9910驱动程序,采用
Verilo
g语言编写,简明清晰,源代码共享,代码风格明朗,很容易理解。
2021-05-12 17:19:52
8KB
FPGA
AD9910
verilo
驱动程序
1
电梯控制器.rar
电梯控制器,EGO1开发板,
Verilo
g语言,vivado开发平台,有数码管显示功能,可显示当前电梯所在楼层,目标楼层,电梯运行时间,支持0到9层楼
2021-05-12 11:24:38
890KB
Verilo
vivado
电梯控制
1
2ASK非相干解调
Verilo
g代码
2ASK非相干解调
Verilo
g代码,串口通信,串口发,串口收,基带速率1200bps 载波速率9600hz
2021-04-29 11:38:24
12.18MB
Verilo
2ASK
非相干解调
1
SHT11温湿度传感器
Verilo
g控制代码
SHT11温湿度传感器
Verilo
g源代码,实现温度采集。经过实际测试,湿度采集只要将命令修改一下就可以。
2021-04-23 19:43:48
18KB
Verilo
SHT11
FPGA
温度传感器
1
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