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功能模块有： 系统划分为信息管理模块、教师模块、学生模块和统计模块等4个模块。模块功能如下：  信息管理模块：包括学生、教师和课程信息管理3个子模块。  学生信息管理：实现对学生信息的添加、修改、删除、查询操作。  教师信息模块：实现对教师信息的添加、修改、删除、查询操作。  课程信息模块：实现对课程的添加，添加时为其分配任课老师、上课时间和地点；实现对课程的修改、删除，查看等。  教师模块：实现查看自己所教授课程、有哪些学生选修，  学生模块：实现学生选课，并可以查看、修改自己的选课信息。 统计模块：对所学课程可以按班级，课程等进行汇总统计。

MAVEN-SSM 用maven平台开发基于spring+mybatis+springmvc三大框架开发选课网站‘ 主要是为了熟练使用三大框架的整合和使用，提高自己的开发效率。 本项目中sql文本有，小伙伴可以直接下载部署使用。也欢迎小伙伴在此基础改版使用，并一起交流学习 q:1208473394(加时请注明)

学生选课系统源码 一个简单的学生选课系统，可做为毕业设计参照使用 主要功能包括：院系管理 专业管理 课程管理 学生管理 教师管理

北航 P0：零件及状态机设计（Logisim） 课下测试：构建CRC校验码计算电路，ALU，正则表达式匹配 课上测试：Logisim完成部件及FSM设计 P1：零件及状态机设计（Verilog-HDL） 课下测试：实现splitter，ALU，格雷码计数器，合法表达式识别，走迷宫 课上测试：Verilog-HDL完成部件及FSM设计 P2：汇编语言 课下测试：矩阵乘法，排序，回文串判断 课上测试：选择题+编程题 P3：Logisim开发单周期CPU 课下测试：完成支持7条指令的单周期CPU设计 课上测试：补充指令 P4：Verilog开发单周期CPU 课下测试：完成支持7条指令的单周期CPU设计 课上测试：补充指令 P5：Verilog开发流水线CPU（1） 课下测试：完成支持10条指令流水线CPU设计 课上测试：流水线工程化方法 P6：Verilog开发流水线CPU（2） 课下测试：完成

Subway-Line-Query-System 包括最少换乘、最少用时、最少停站的地铁路线查询小系统（年久失修的小课设） USAGE 基于Python(Python 2.7.5)，包括广度优先遍历实现最少停站，DIJKSTRA实现单源最短路径，相交矩阵配合BFS实现的最少换乘算法。 ####运行实例

JSP高校选课系统源码 源码描述： 一、源码介绍 JSP高校选课系统源码servlet，mysql实现。 二、主要功能 用户可以操作：注册，登录，基本信息，选择课程，查询课程，修改密码等操作。 管理员身份登录后台：功能不完善。 三、注意事项 开发环境为eclipse，数据库为mysql.

Node.js + Express + MySQL学生选课系统 微型的学生选课系统，提供对数据库最基础的增删改查功能。 面向学生功能： 查看所有课程，并进行选课 查看所有课程，并进行退课 查看个人信息，并进行修改 查看已选课程的任课老师信息 面向教师功能： 查看所有课程，并进行任课 查看已带课程，并进行退课 版本号 Node.js v4.2.6 快递v4.14.0 测试账号 学生登录账号：201444025022密码：12345 教师登录账号：t001密码：12345 截图 更多截图请看demo

毕业设计所写的一个程序。基于贪婪算法，还有论文哦。不要要找我索要