本压缩包里有蔡氏混沌电路和洛伦兹混沌电路的Multisim仿真图。
该电路用一个分压器代替模拟电压。不管为何值,在与比较器前的分压器比较时,总会大于(等于)某几个分压数值(例如下面4个),而小于其他的(上面3个)分压数值。于是下面的4个比较器输出高电平,而上面的3个比较器输出低电平。其结果经寄存器保持,并有译码器转换成二进制数。
2021-12-12 18:20:31 172KB 并联比较型AD
实验报告,带详细电路图和步骤 1、通过实验了解并掌握Multisim软件的使用方法,电路仿真基本方法及Multisim电路分析方法。 2、使用电路仿真方法验证所学的交流电路和三相电路的基础定律,并了解各种电路的特性。
2021-12-05 00:11:16 2.22MB Multisim 仿真 三相电路
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可重触发集成单稳态触发器74LS123实验电路multisim源文件,multisim10及以上版本可以正常打开仿真,是教材上的电路,可以直接仿真,方便大家学习。
2021-12-03 14:59:51 46KB 74LS123
lf374的基本差分电路multisim仿真,放大倍数可通过电阻调节
2021-11-29 14:35:46 90KB lf374 multisim 仿真
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电风扇控制电路multisim仿真源文件,使用74LS148+74LS273方案,分为停弱中强四档,有睡眠按键,multisim10及以上版本软件打开
2021-11-29 13:26:08 318KB multisim
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Multisim仿真实例设计源码,数字电路模电电路Multisim应用仿真例程,可以做你的学习实验参考。
Multisim创建LM386所需符号文件
2021-10-28 11:47:39 13KB 模拟电路 Multisim
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简易两路时分复用电路设计的multisim仿真文件,通原课设 要求完成的主要任务: 1、完成一个简易的两路时分复用通信电路的设计,实现两路不同模拟信号的分时传输功能。 2、在信号接收端能够完整还原出两路原始模拟信号。 3、选用相应的编码传输方式与同步方式,进行滤波器设计。
2021-10-23 09:16:32 642KB 两路 时分复用电路 multisim 仿真
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目录: SD1 2-1 与逻辑 2-2 或逻辑 2-3 非逻辑 2-4 与非逻辑 2-5 或非逻辑 2-6 与或非逻辑 2-7 异或逻辑 2-8 逻辑函数的转换(1) 2-9 逻辑函数的转换(2) SD2 2-10 二极管开关电路 2-11 双极性三极管开关电路 2-12 MOS三极管开关电路 2-13 二极管与门电路 2-14 二极管或门电路 2-15 三极管非门 2-16 TTL反相器的基本电路及性能测试 2-17 TTL与非门电路 2-18 TTL或非门电路 2-19 TTL与或非门电路 2-20 TTL异或门电路 2-21 集电极开路门电路 2-22 OC门线与连接 2-23 三态输出门电路 2-24 74H系列与非门(74H00)的电路结构及性能测试 2-25 74S系列与非门(74S00)的电路结构 2-26 CMOS反相器的电路结构 2-27 CMOS反相器的输入保护电路及特性测试 2-28 CMOS与非门 2-29 CMOS或非门 2-30 漏极开路输出的与非门(CC40107) 2-31 CMOS双向模拟开关4066 2-32CMOS三态门 (1) 2-33 CMOS三态门(2) 2-34 Bi-CMOS反相器 2-35 Bi-CMOS与非门电路 2-36 Bi-CMOS或非门电路 SD3 2-37 三位二进制普通编码器 2-38 8线3线优先编码器74LS148 2-39 用两片74LS148组成的16线4线优先编码器 2-40 二-十进制优先编码器74LS147 2-41 用二极管与门阵列组成的3线8线译码器 2-42 3线8线译码器74LS138 2-43 两片74LS138接成4线16线译码器 2-44 二-十进制译码器74LS42 2-45 七段显示译码器74LS48 2-46 双4选1数据选择器74LS153 2-47 采用CMOS传输门结构的数据选择器4539 2-48 8选1数据选择器74LS152 2-49 半加器 2-50 双全加器74LS183 2-51 4位超前进位加法器74LS283 2-52 4位数值比较器4585 2-53 2线-4线译码器中的竞争-冒险现象 SD4 2-54 用或非门组成的基本RS触发器 2-55用与非门组成的基本RS触发器 2-56 同步RS触发器 2-57 带异步置位复位端的同步RS触发器 2-58 D锁存器电路 2-59 集成D锁存器74LS75 2-60 主从JK触发器74LS76 2-61 与输入主从JK触发器7472 2-62 CMOS传输门组成的边沿JK触发器4027 2-63 维持阻塞结构的边沿JK触发器74LS109 SD5 2-64 例5.2.1的时序逻辑电路 2-65 例5.2.3的时序逻辑电路 2-66 例5.2.4的时序逻辑电路 2-67 同步D触发器74LS75组成的4位寄存器 2-68 用维持阻塞D触发器74LS175组成的4位寄存器 2-69 用D触发器74LS74组成的移位寄存器 2-70 用JK触发器组成的移位寄存器 2-71 四位双向移位寄存器74LS194 2-72 用两片74LS194接成八位双向移位寄存器 2-73 例5.3.1电路及功能演示 2-74 用T触发器构成的同步二进制加法计数器 2-75 4位同步二进制加法计数器74LS161 2-76 用T'触发器构成的同步2进制加法计数器4520 2-77 用T触发器构成的同步2进制减法计数器 2-78 单时钟同步2进制可逆计数器74LS191 2-79 双时钟同步2进制可逆计数器74LS193 2-80 同步10进制加法计数器 2-81 同步10进制加法计数器74LS160 2-82 同步10进制减法计数器 2-83 单时钟同步10进制可逆计数器74LS190 2-84 用T'触发器构成的异步二进制加法计数器 2-85 用T'触发器构成的异步二进制减法计数器 2-86 异步10进制加法计数器 2-87 二-五-十进制异步计数器74LS290 2-88 用置零法将74LS160接成6进制计数器 2-89 2-88电路的改进 2-90 用置数法将74LS160接成6进制计数器(1) 2-91 用置数法将74LS160接成6进制计数器(2) 2-92 用两片74LS160按并行进位接成100进制计数器 2-93用两片74LS160按串行进位接成100进制计数器 2-94 按并行进位接成54进制计
2021-10-20 13:19:45 13.81MB 数字电路 multisim 仿真
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