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定浮点数转换程序(verilog)
a) 并采用门级编程,实现4-bit无符号整数到浮点数转换; b) 并采用RTL级编程,实现4-bit无符号整数到浮点数转换; c) 分别对门级编程实现和RTL级编程实现的组合逻辑电路进行功能仿真; d) 利用“实验板”对两种4-bit无符号整数到浮点数转换电路进行综合和实现,设定定点数输入和浮点数输出的人机接口,建议用4个LED灯表示输入值,操作开关或按动按钮后进行转换,用数码管显示有效位和幂指数;(任何合理的人机接口都是可以接受的)
2023-02-14 16:50:24
4.63MB
FPGA
verilo
数字电路
1
数字电子技术基础(阎石 第5版)
数字电子技术基础(阎石 第5版)数字电子技术基础(阎石 第5版)数字电子技术基础(阎石 第5版)
2023-02-10 23:56:13
27.3MB
数字电路
数字电子
verilog
1
数字电路简明教程(美)汤普森(Thompson R.D.)带书签
条理清晰,易懂易学,体现了作者丰富的教学实践经验和宽泛的专业知识面,从不同侧面介绍了数字电路的基本概念、基本原理和基本分析方法,并给出了许多实际电路应用及其故障诊断的例子,能够满足大多数读者的需求,使其在数字电路课程的学习中获益最大。《国外电子与通信教材系列?数字电路简明教程》提供了大量习题,能够为读者打下坚实的基础。
2023-02-09 18:54:38
15.41MB
数字电路
1
八路抢答器(74LS373+74LS147+4511BD显示译码器)
74ls373·74ls147d· 4511bd· 源文件
2023-01-04 07:48:25
561KB
数字电路
1
D触发器(74LS74)构成一个4分频器
用74LS74构成一个4分频器,即输出信号的频率为输入信号频率的四分之一,该文件为Multisim14仿真文件,测试可用
2023-01-02 22:08:30
108KB
Multisim
分频器
数字电路
1
不使用51单片机的倒计时电路
用中、小规模集成电路和分立元件设计四位倒计时报警电路。 主要技术指标: 1.四位计数器实现倒计时; 2.能够设置四位计数器的初始值,一个位选键、一个+键、一个-键和一个确定键,通过四个键对四位计数器的每位初始值进行设置。 3.倒计时为“0000”时锁存状态,并发出报警信号。
2022-12-27 11:59:19
114KB
数字电路
倒计时
1
Verilog实现分频器设计(奇偶分频、半整数分频)
用Verilog实现分频器设计,主要包括偶分频(占空比50%),奇分频(占空比50%),以及半整数分频(比如2.5分频、3.5分频等,占空比不可能为50%,只能接近50%)。 半整数分频采用简单有效的算法,可以实现2.5倍分频以上的所有半整数分频。 提供了设计源代码、测试仿真代码。
2022-12-26 20:54:54
2KB
verilog
分频器
数字电路
奇偶分频
1
基于数字电路的八路抢答器
〖基本要求〗利用数字电路设计一八路抢答器,要求: 1) 允许八路参加,并具有锁定功能,用LED实现最先抢答的队号码,系统设置外部清除键,按动清除键,LED显示器自动清零灭灯。 2)数字显示功能:数字抢答器定时为30S,启动开启键以后要求Ⅰ)定时开始;Ⅱ)扬声器要短暂报警;Ⅲ)发光二极管亮灯;如果在30S内抢答有效,计时结束,30S内抢答无效,系统短暂报警,发光二极管灯灭
2022-12-25 17:57:23
318KB
数字电路,
抢答器
1
数字电路乘法器设计
本实验利用两位二进制数乘法中乘数各位与被乘数相乘后移位相加的原理,拓展得到两个四位二进制数相乘原理。在max+plus2上进行原理图设计和软件仿真,软件通过后,下载到EPF10K10中,在GW48系列EDA/SOC实验开发系统完成硬件调试。
2022-12-24 18:26:45
397KB
乘法器
数电
maxplus2
1
北邮数字电路与逻辑设计实验报告.pdf
北邮数字电路与逻辑设计实验报告.pdf
2022-12-22 18:21:52
2.75MB
文档资料
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