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基于FPGA的等精度数字频率计
基于FPGA的等精度数字频率计,含代码的完整设计
2019-12-21 22:08:36
1.56MB
FPGA
1
基于51单片机控制的函数信号发生器(含C源码)
能够产生正弦波、方波、三角波 可以作为频率计测频率 能产生1Hz—20MHz的波形 输出或输入频率经74HC390分频后,由单片机完成自动频率检测显示
2019-12-21 22:02:25
143KB
波形产生器、频率计、51单片机控制
1
我的频率计
proteus
我的频率计
proteus!!!!!!!!!!!!!!!!!!!!!!
2019-12-21 22:01:13
76KB
我的频率计
proteus
1
频率计仿真 51单片机 测频率
测亮外接脉冲频率,并将频率显示在lcd1602上。含有仿真图和程序,是非常好的资源。谢谢大家支持。
2019-12-21 21:59:53
402KB
频率计
频率计仿真
仿真
51单片机
1
基于FPGA的频率计,DE2开发板,VHDL
基于FPGA的频率计,使用DE2开发板,编程语言使用的是VHDL。它达到的效果是在DE2板上用数码管显示270。因为DE2板上有一个27M的晶振,我用它做信号源,这样就不用再外接信号了。但27M数码管位数不够用,所以我将它分频之后显示。
2019-12-21 21:57:31
282KB
频率计
VHDL
DE2
1
15年数字频率计100MHZ.zip
完全实现2015年数字频率计所有要求,可达到100M频率测量
2019-12-21 21:56:45
23.42MB
电赛
STM32
FPGA
1
51单片机频率计程序
内含51单片机频率计的详细程序,频率计误差<0.5%,可测频率范围宽,应用广泛,程序简单
2019-12-21 21:46:34
23KB
51单片机
频率计
1
2015年电赛F题数字频率计完整工程代码(国一)
测量频率采用等精度法,信号通过高速比较器直接接入FPGA。本题难点是测量时间间隔,相对误差10^-2 ,时间间隔范围0.1US-100MS。因此时间的分辨率要达到1ns,也就是时钟频率要跑到1Ghz,大多数FPGA是不可能完成。本方案采用状态法测量时间间隔,采用PLL倍频出来的250Mhz,等效成1Ghz的采样频率,满足精度要求,工程代码完整分FPGA工程和stm32工程,转换公式注释明了。
2019-12-21 21:35:07
16.31MB
代码
1
EDA数字频率计 vhdl语言
EDA频率计 vhdlEDA频率计 vhdlEDA频率计 vhdlEDA频率计 vhdl
2019-12-21 21:32:43
1.29MB
频率计
1
仿真数字频率计实验报告
数字电路仿真实验报告,用Multisim软件仿真数字频率计。
2019-12-21 21:30:29
303KB
multisim仿真
1
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