RISC-V最新特权指令规范，包括H扩展等新内容

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RV32I单周期Logisim仿真 描述 该存储库包含在称为Logic Simulator上的RISC-V单周期32位处理器仿真 该电路包含两个RAM MAR（存储器地址寄存器）的32位ALU，32位数据总线，16KB ROM / RAM，12位地址总线。 寄存器文件包含32个寄存器，数据宽度为32位。 用于验证所有电路组件的故障排除代码。 零件 ALU 注册文件 内存地址寄存器 立即生成 控制单元 类型解码 控制解码 内存 分支电路 程序计数器 在指导下 先决条件工具 Logisim软件 金星在线模拟器 Github 设计程序 首先，学习RV32I指令集体系结构的基本指令并学习其功能。 要了解后端工作方式，请使用Venus Online RV32I Simulator。 该模拟器有助于更快地掌握指令背后的工作。 在Logic Simulator软件上，首先从程序计数器和存储器地址

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指数 通过插件系统向CPU添加自定义指令 通过插件系统添加新的CSR CPU时钟和复位 VexRiscv架构外挂程式 描述 该存储库托管以SpinalHDL编写的RISC-V实现。 以下是一些规格： RV32I [M] [C] [A]指令集（仅单个内核内的原子） 从2到5+阶段的流水线化（[Fetch * X]，解码，执行，[内存]，[回写]） 1.44 DMIPS / Mhz-几乎启用了所有功能时不进行内联（当启用分频器查找表时为1.57 DMIPS / Mhz） 针对FPGA进行了优化，不使用任何供应商特定的IP块/原语 AXI4，Avalon，叉骨准备就绪 可选的MUL / DIV扩展 可选的指令和数据缓存 可选的硬件重新装满的MMU 可选的调试扩展，允许通过GDB >> openOCD >> JTAG连接进行Eclipse调试 使用RISC-V Privileged

现在的高性能RISC-V处理器和Arm比起来如何？.docx

顶石引擎 Capstone是一个反汇编框架，其目标是成为安全社区中进行二进制分析和逆转的最终Disasm引擎。 Capstone由Nguyen Anh Quynh创建，然后由一个小型社区开发和维护，具有一些无与伦比的功能： 支持多种硬件架构：ARM，ARM64（ARMv8），以太坊VM，M68K，Mips，MOS65XX，PPC，Sparc，SystemZ，TMS320C64X，M680X，XCore和X86（包括X86_64）。 具有干净/简单/轻巧/直观的中性API。 提供有关反汇编指令（其他人称为“分解器”）的详细信息。 提供反汇编指令的语义，例如读取和写入的隐式寄存器列表。

RISC-V指令集体系结构手册，是EETOP网友：要你命3000（论坛username）,花费了大量时间，翻译的最新的RISC-V体系结构手册，提供给大家学习使用！

Logisim软件上的Risc V单周期仿真。 代码： 柜台 斐波那契 故障排除代码文件