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Xilinx Cordic IP核的用法( 以arctan为例）

在ISE14.6开发环境中，调用Xilinx的Cordic IP核实现arctan算法。

2022-11-16 20:45:27 2.59MB Cordic IP FPGA arctan

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Altera-LVDS的IP核设计详解.zip_LVDS altera_altera ip核详解_altera lvds IP_

自己总结的Altera_LVDS的IP核的设计及仿真分析，非常使用，已在实际工程中应用到

2022-11-08 08:31:07 3.04MB lvds_altera altera_ip核详解 altera_lvds_ip lvds_ip

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基于APB的uart_ip核设计与验证

ic设计验证，apb uart

2022-10-28 22:23:52 927KB apb uart ic

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IP核gtx学习笔记.docx

IP核学习笔记。TX和RX时钟分频器可以分别从PLL0或PLL1中选择时钟，以允许TX和RX数据路径使用不同的参考时钟输入以异步频率工作。 GTP收发器的TX和RX可以从PLL0或PLL1接收时钟。必须先初始化TX和RX使用的相关PLL（PLL0 / PLL1），然后再初始化TX和RX。

2022-10-12 10:58:53 1.35MB fpga

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基于SJA1000 IP核的CAN总线通信系统

分析了CAN总线控制器的工作原理，以SJA1000为模型，提出基于SOPC技术的CAN总线控制器的设计方案，并完成SJA1000 IP核的设计；完成了在Altcra的Cyclone III型FPGA芯片上集成微处理器核、SJA1000 IP核、数据RAM、程序ROM为一体的完整CAN总线通信系统的设计。实验结果验证了SJA1000 IP核设计方案的合理性。

2022-09-27 15:46:15 302KB CAN总线 SOPC IP核 FPGA

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pg071-v-smpte-sdi

smpte核说明

2022-09-27 09:05:54 1.64MB ip核说明

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fpu_latest.tar.gz

FPU VERILOG IP核。开发文档

2022-09-07 09:30:21 347KB FPU verilog IP核

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Xilinx Srio详解&IP核使用.docx

Xilinx Srio详解&IP核使用，还算比较有用的资料，尤其是对IP核接口各个信号的说明很有用，基本值得参考

2022-08-31 11:10:08 2.15MB rapidio

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xilinx FPGA ROM IP核的使用（VHDL&ISE）

2022-08-25 19:05:08 5.09MB rom

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Vivado FFT IP核例程

FFT实验例程完整版工程，包含tb激励文件，可以仿真，建议使用modelsim进行仿真。可以查看https://blog.csdn.net/qq_41894385/article/details/124611267文档，解压密码也在该文档。

2022-08-25 11:27:06 83.46MB FFT核 VIvado

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