压缩包中的有多个protues文件可以直接打开进行运行，是不同阶段和版本的时钟测试，时钟包括年月日，时钟可以自己动，也可以自己调时间，也可以暂停，没有分闰年平年。
2023-04-14 00:43:46
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硬件架构的艺术：数字电路的设计方法与技术
数字电路设计领域的扛鼎之作。选图丰富，帮助初学者与中高级读者完善与提高自己的知识结构
2023-04-03 15:41:53
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3.1 电网电压同步信号采样电路设计
DSTATCOM 的工作与同步信号有密切的关系，所有的动作都要以同步信号
作为参考，故硬件上的同步电路是不可或缺的。同步信号的产生有多种方法。
第一种方法为最简单的过零同步，即对系统三相电压进行处理后取出一相基波
正序电压作为同步信号，把该同步信号的过零时刻作为脉冲发生器的同步点，
通过测量连续两个正向过零点之间的时间作为周期计算出同步信号的频率，因
2023-03-26 22:41:28
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MIT的经典教材，想学VHDL的可以下下来看看，300多页，即使你没有基础，也可以顺利入门，直至成为一名高手！老外的教材就是写得好，由浅入深，不像国内的，抄来抄去。
2023-03-19 16:09:43
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课题利用LM35温度传感器检测工作环境温度，并通过LM358对传感器输出的电压放大，利用LM358构成电压比较器，调节滑动变阻器使基准电压为5V，当温度升高，LM35传感器输出电压降低至基准电压5V以下，电压比较器输出高电平，控制三极管导通，继电器吸合线圈，常闭触电断开，LED灯熄灭，反之当温度处于正常温度下，LM35传感器输出电压高于基准电压，电压比较器输出低电平，三极管截止，LED灯处于点亮状态。
2023-03-07 22:18:31
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74HC165是个并行输入串行输出的逻辑芯片，了解一款芯片都是从它的datasheet开始，下面以NXP公司74HC165为例进行介绍。
74HC165/74HCT165是一个8位串行或并行输入，串行输出的移位寄存器。具有一个串行输入（DS引脚），8个并行数据输入（D0到D7）和两个互补串行输出的功能。当PL引脚为低时，D0-D7端的数据进入移位寄存器。当PL引脚为高时，数据从DS引脚串行进入寄存器。当CE引脚为低时，使能时钟，数据在时钟CP上升时数据进行移位。当CE引脚为高时，失能时钟，时钟输入无效
2023-03-06 09:16:56
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