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数字时钟-verilog程序.rar
数字时钟verilog程序 拟设计一个具有时、分、秒显示的基本功能以及具有整点报时、闹钟设定及提醒功能的数字时钟,具体要求如下: (1) 能准确计时,并以数字形式在数码管上显示时、分、秒,(小时按24小时进制) (2) 具有调节分钟、小时的功能 (3) 具有整点报时功能,即当分钟为00时,要有LED灯显示来表明到了整点 (4) 具有闹钟功能,能自己设计闹钟时间,当时钟时间与闹钟时间一致时(分钟与小时一致,对秒钟无要求),要有LED灯显示表明到了闹钟设定时间
2021-10-24 18:53:02
5KB
Verilog
数字电子技术基础
硬件描述语言
硬件设计
1
数字时钟 verilog程序
verilog 数字时钟程序 clock.v
2021-10-24 15:31:44
3KB
verilog
clock
1
SHA-1哈希加密算法
的verilog程序
利用verilog语言实现了SHA-1机密算法,具体算法与加密芯片ds28e01一致
2021-10-13 10:23:11
11KB
SHA-1
加密
算法
verilog
1
旋转编码器verilog程序
module rotencoder(A,B,clk,reset,output8,lock,cs); input clk,A,B,reset,lock,cs; output[7:0] output8; reg[15:0] count; reg[15:0] out_lock; reg[7:0] output_8; reg A1,B1,A2,B2,cs1,cs2; always@(posedge clk)
2021-09-17 16:09:46
157KB
旋转编码器
verilog
1
万年历(verilog程序)
一个用verilog语言写的万年历程序,包括源文件和测试用的testbentch文件
2021-09-13 15:58:46
2KB
verilog
万年历
程序
1
CRC校验码Verilog程序
算法可以根据自己需要调整测试,非常好用,主要在于不用查表,直接得出计算结果,计算占用资源少
2021-09-08 19:06:57
9.64MB
CRC16校验码
1
fpga操作tlv2543 AD采样
的verilog程序
fpga操作tlv2543 AD采样
的verilog程序
2021-07-13 10:28:15
3KB
tlv2543
verilog
1
基于FPGA的PCI接口源代码及Testbench Verilog程序代码
Lattice 公司的基于FPGA的PCI接口源代码及Testbench Verilog程序代码,很详细
2021-07-10 00:15:47
943KB
FPGA
PCI
1
用7段共阳数码管显示任意一个4位数
的verilog程序
用7段共阳数码管显示任意一个4位数
的verilog程序
,如果你的数码管是共阴极,你知道怎么改。另外,把要显示的数N改成输入,就可以加到其他模块里面去被调用了。
2021-07-08 15:25:09
2KB
数码管
verilog
FPGA
1
DE2-70开发板程序实例
这是DE2-70开发板上的7个典型程序实例,主要基于verilog 语言编写
2021-06-30 10:49:23
21.6MB
verilog程序、nios
ii、DE2-70、fpga
1
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