针对NAND Flash应用,完成了并行化BCH编译码器硬件设计。采用寄存器传输级硬件描述语言,利用LFSR电路、计算伴随式、求解关键方程、Chien搜索算法等技术方法完成了BCH编译码算法在FPGA上的硬件实现。相比于传统串行实现方案,采用并行化实现提高了编译码器的速度。搭建了基于SoPC技术的嵌入式验证平台,在Nios处理器的控制下能快速高效地完成对BCH编译码算法的验证,具有测试环境可配置、测试向量覆盖率高、测试流程智能化的特点。
2023-04-05 19:09:36 277KB 并行化
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一种改进的LDPC码LLR BP译码算法,张小花,李艳萍, LLR BP译码算法由于引进了指数运算和对数运算使得复杂度很高,不利于硬件实现。为了降低复杂度,提出一种改进的LLR BP算法。主要思��
2023-04-05 14:44:12 274KB 无线通信
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汉明码编译码系统程序,完整可实现的工程文件,亲测
2023-04-02 02:31:06 326KB 汉明码 编译码 程序
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基于Goertzel算法的选呼译码FPGA模块设计.pdf
2023-03-31 12:45:10 4.28MB FPGA 硬件技术 硬件开发 参考文献
针对脉冲位置调制(PPM)与多级编码结合中的错误传播问题,利用多阶段译码原理的“链式规则”,提出一种基于迭代的解调译码方法,给出了8-PPM多级编码调制的硬判决迭代算法。仿真分析表明,迭代解调译码方法可以改善错误传播现象,降低系统的误码率;在相同迭代次数下,信道衰减越大,该译码方法获得的增益越明显。综合考虑性能改善效果及成本,M阶编码调制系统的迭代次数宜选M次以内。
2023-03-31 10:11:47 6.4MB 光通信 脉冲位置 多级编码 多阶段解
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文中针对Tetra 通信系统中采用的ACELP 算法, 分析了该算法的基本原理, 介绍了其算法基于
VC++6.0 的软件实现过程,重点阐述了ACELP 在网络通信中的实现及应用情况。
2023-03-20 19:50:22 1.32MB  ACELP;编译码;算法;网络通信
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本设计实现了74139译码器testbench的vhdl语言实现,可有效验证其功能。
2023-03-17 14:22:44 4KB 74139译码器的testbench的vhdl语言
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在已知的多输入多输出(MIMO)及正交频分复用(OFDM)系统的信号检测算法中,球型译码检测算法的译码性能十分接近于性能最优的最大似然检测算法,并且其译码复杂度有很大的降低,但其会受到译码半径的影响。普通的球型译码检测算法,信道噪声对算法的译码半径影响较大,为了降低信道噪声对译码半径的影响度,提出了一种新型的球型译码检测算法,该算法在译码初始半径分别根据两种不同的情况作出选择。仿真结果显示,其选择的译码半径受噪声的影响极小,达到了降低译码复杂度的目的。总体而言,新型的球型译码检测算法极大地降低了译码复杂度
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基于改进的BP译码算法-LLR BP译码算法,在AwGN信道下,在量化范围、量化比特数、量化方式选择这三方面分别对输入信号和中间变量进行了性能仿真与对比,最后经过分析比较,提出了一种新型和有效的量化方案.笔者采用的奇偶校验码为基于802.16e标准的准循环低密度奇偶校验码(QC-LDPC).在假设输入信号为等概输入,且设置译码算法中最大迭代次数为10的前提下,通过MATLAB仿真,可发现准循环低密度奇偶校验码不但具有良好的性能,而且更有利于硬件的实现.与此同时,与未量化的LLR BP译码算法相比,文中提出
2023-03-17 09:35:18 311KB 自然科学 论文
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信道编码方案中的极化码是5G通信领域中的研究热点。极化码在串行抵消译码下容易受到差错传播的影响,在中短码长上的性能并不理想。针对这些问题,在不同仿真情况下对系统极化码和非系统极化码的性能差异性进行了研究。仿真结果表明,系统极化码比非系统极化码具有更好的误码率性能;相比非系统极化码,系统极化码在串行抵消译码下对差错传播具有较强的抵抗性。上述结果对极化码性能的优化以及5G通信有重要的理论价值。
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