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实验一 数字基带信号 实验二 数字调制
HDB3码中提取
位同步
信号的原理 信源代码中的“1”码相对应的AMI码及HDB3码 2DPSK信号的相位变化与绝对码的关系以及2DPSK信号的相位变化与相对码的关系 绝对码至相对码的变换规律、相对码至绝对码的变换规律
2021-05-30 20:37:16
361KB
HDB3码中提取位同步信号的原理
信源代码中的“1”码相对应的AMI码及HDB3码
2DPSK信号的相位变化与绝对码的关系以及2DPSK信号的相位变化与相对码的关系
1
基于FPGA的GPS接收机
位同步
帧同步设计与实现
为了能在GPS接收端获取正确导航电文,研究了GPS接收机
位同步
、帧同步的基本原理和实现方式。提出一种采用FPGA来实现
位同步
、帧同步系统的设计方案。使用Xilinx开发软件,通过Verilog代码完成对
位同步
、帧同步的设计并在硬件平台上进行调试。通过Chip Scope和逻辑分析仪进行验证,结果表明该设计方案正确可靠,满足设计要求。
2021-05-25 22:42:26
1.11MB
GPS接收机;
位同步;
帧同步;
FPGA
1
位同步
提取程序(vhdl)
使用VHDL编写的基于CPLD的
位同步
提取程序(类似CDR)
2021-05-18 08:08:14
2KB
CPLD/FPGA
VHDL
CDR
DPLL
1
通信
位同步
的verilog代码,很有参考意义
无线通信
位同步
的verilog代码,很有参考意义
2021-05-02 00:51:03
2KB
无线通信,位同步,verilog
1
位同步
时钟提取电路设计与实现.rar
本文设计的方案可以从异步串行码流中提取
位同步
时钟信号,设计思想的基本出发点是在外部码流(code_in)的上升沿和本地时钟(clk)上跳沿相比较
2021-05-02 00:43:52
709KB
位同步时钟提取电路设计与实现
1
基于FPGA的新型
位同步
时钟提取方案
此方案相比于传统的数字锁相环来说能够准确、快速的提取高速串行数据的同步时钟,即使输入码元有毛刺,也具有很好的时钟恢复调整功能
2021-05-01 23:36:18
2.13MB
FPGA
同步时钟
1
毕业设计 基于MATLAB的
位同步
调制解调 源代码
东西整得很不错 毕业设计专用。。。。。。。。。。。。。
2021-02-18 19:42:59
7KB
MATLAB
位同步
1
MFSK信号新型正交解调算法
对数字化正交解调技术进行研究,从仪器系统设计的灵活性和通用性出发,提出MFSK信号的新型正交解调算法,对下变频后的基带同向和正交分量进行鉴频运算,根据瞬时频率符号跳变检测和双线性插值算法提取
位同步
信号,抽样判决得到码元信息,根据实际调制映射关系解出比特数据。本方案成功用于某通信测试仪项目,实现了2FSK、4FSK信号的解调,数据源选用自定义码和随机码(PN9、PN11),并实现了误码分析。
2021-01-28 11:24:08
1.69MB
正交解调;
鉴频算法;
位同步;
调制映射
1
基于FPGA的
位同步
信号提取
基于FPGA的
位同步
信号提取,总结过的,大家共享
2019-12-21 20:18:37
195KB
FPGA
1
基于MATLAB的基带传输
位同步
信号提取
位同步
信号提取的流程为:过零检测;微分;整流;带通滤波;整形,过零检测 基于以上步骤利用MATLAB的M文件函数编程
2019-12-21 20:03:27
3KB
位同步提取
1
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