电力规约通用协议编解码模块和调试工具 支持101 103 104
2023-04-12 11:44:25 1.18MB 电力规约 协议编解码 规约调试
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对LTE系统中ASN.1编解码模块的设计与部分实现的研究。首先,简要介绍了ASN.1的基本概念、语法原则以及BER、PER编解码规则;然后,分析了ASN.1的应用流程和LTE协议栈需求,针对LTE协议栈设计了ASN.1编解码模块;最后,以BCCH_BCH_Message为例,对ASN.1编解码模块进行了部分实现。其实现首先将LTE协议中RRC消息的ASN.1描述按照一定规则转换成C语言的数据结构;然后根据转换好的C语言数据结构按照编码规则为每一个数据结构实现编解码函数。
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在电脑播放视频时提示“播放此视频需要新的编解码器”需要购买HEVC视频扩展,可以直接安装本资源的HEVC视频扩展安装包(免费),重新打开视频即可,亲测有效!!!
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完整的硕士论文,涉及到算法,软件仿真,硬件实现,很好的资料
2023-03-30 20:33:52 3.6MB DSP G.729
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实现了BCH(21,31)对数据的编码解码和纠错
2023-03-27 10:28:14 5KB BCH(21 31) JAVA
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X509数字证书编解码
2023-03-26 22:06:55 15KB X509
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Visual+C++音视频编解码技术及实践
2023-03-24 18:23:41 13.26MB 音频 视频 编解码
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ITU-G.721编解码实现 快捷,实用 1. * This source code is a product of Sun Microsystems, Inc. and is provided 2. * for unrestricted use. Users may copy or modify this source code without 3. * charge.
2023-03-20 18:46:07 43KB ITU-G.721
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国外流行的字符转换工具,二进制、十六进制、十进制、ASC、字符串之间自由转换。
2023-03-18 22:00:04 151KB JPK 编解码
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FPGA设计曼彻斯特编解码Verilog源代码 module md (rst,clk16x,mdi,rdn,dout,data_ready) ; input rst ; input clk16x ; input mdi ; input rdn ; output [7:0] dout ; output data_ready ; reg clk1x_enable ; reg mdi1 ; reg mdi2 ; reg [7:0] dout ; reg [3:0] no_bits_rcvd ; reg [3:0] clkdiv ; reg data_ready ; wire clk1x ; reg nrz ; wire sample ; reg [7:0] rsr ; // Generate 2 FF register to accept serial Manchester data in always @(posedge clk16x or posedge rst) begin if (rst) begin mdi1 <= 1'b0 ; mdi2 <= 1'b0 ; end el