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SIMJTAG MCU模拟JTAG口在线编程
CPLD
_v1
本文以Lattice
CPLD
为例子,详细介绍了MCU如何模拟JTAG在线加载
CPLD
。资源包括说明文档和C代码。
2021-03-17 13:50:50
32KB
JTAG
1
visio 波形工具.rar
基于visio的常用FPGA工具箱,主要用于绘制FPGA波形,包括时序图、状态机等常用的绘制。同时包含了常用的逻辑组件,如反相器、寄存器等常用的IC。电子工程师写论文画图必备模板啊。
2021-03-14 22:05:23
139KB
fpga/cpld
mcu
嵌入式
驱动程序
1
基于
CPLD
的智力竞赛抢答器.pdf
基于
CPLD
的智力竞赛抢答器,内含源程序、顶层原理图,可以借助此文档实现基于
CPLD
的智力竞赛抢答器。
2021-03-14 16:04:17
1.13MB
CPLD
抢答器
VHDL
FPGA
1
基于
CPLD
的三相多波形函数发生器论文资料.rar
基于
CPLD
的三相多波形函数发生器论文资料
2021-03-13 20:05:05
352KB
基于CPLD的三相多波形函数发生
MAX7000 manual & Pin table-unlocked.pdf
MAX7000系列手册以及引脚定义表,英文版。MAX7128S MAX7128E等7000系列引脚定义都有
2021-03-12 22:03:25
1.31MB
MAX7000
MAX7128E
MAX7128S
CPLD
1
EPM7128E_EPM7128S Pin table.pdf
EPM7128E&EPM7128S两个系列
CPLD
的引脚定义表;
2021-03-12 22:03:25
35KB
CPLD
MAX7000
EPM7128
引脚
1
可编程逻辑器件原理与应用复习资料.pdf
USTC FPGA复习总结
2021-03-07 16:01:41
1.39MB
fpga/cpld
1
traf_light.zip
使用Quartcs II 环境编用Verilog HDL写的交通灯程序
2021-03-07 13:43:49
fpga/cpld
verilog
1
异步FIFO的VHDL实现
--rtl 这是源代码 --sim 这是modelsim仿真目录 已经验证,可以实现异步FIFO 两级寄存器实现读写指针的同步,地址采用格雷码形式防止亚稳态。异步FIFO的源码,个人觉得不易理解,故上传本人最近写的源码,与大家一起分享
2021-03-05 18:06:17
56KB
FPGA
CPLD
VHDL
1
jtag.c升级
cpld
c语言源代码
通过jtag为
CPLD
做软件升级
2021-03-05 18:04:50
38KB
cpld/jtag
1
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