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vhdl 16位乘法器

使用硬件编程语言设计了一个16位加法器并用matlab模拟输入和输出并对这次课程设计进行了总结 Matrix calculation is one of the fundamental mathematic calculations commonly used in advanced signal processing algorithms for a wide range of applications, such as satellite navigation systems, complex control systems and etc. In order to implement such advanced signal processing algorithms on an FPGA based embedded system, we need to use VHDL to design a matrix multiplier core for a Xilinx FPGA device.

2020-04-01 03:08:14 7.94MB vhdl matlab

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Verilog 16位乘法器

通过移位相加的方法，实现两个16位二进制数据的相乘。经过测试，能够得到正确的结果。

2020-04-01 03:07:41 2KB Verilog 乘法器

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verilog HDL 16位乘法器实现及testbench文件

适合新手学习verilog HDL语言。并附有testbench文件，共新手学习使用。

2020-04-01 03:03:11 1KB testbench+verilog HDL 16位乘法器

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atmel 8位，16位，32位单片机Altium Designe 封装库

Altium Designe封装库，atmega系列单机封装。

2020-02-23 03:13:01 11.05MB atmega pcb 封装

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MSP430系列16位超低功耗单片机原理与应用（沈建华）

MSP430的入门学习教材，供学习参考，在此推荐。

2020-01-08 03:04:51 20.86MB MSP430

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Verilog实现16位计数器

Verilog实现16位计数器(自增\自减\增减三种模式)

2020-01-03 11:28:48 33KB Verilog

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51单片机实现CRC校验

在Keil C上用C语言实现的8位及16位CRC校验的程序，另附相关的参考资料。

2020-01-03 11:23:53 516KB 51单片机 C语言 8位及16位CRC

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VHDL编写的16位CPU

VHDL编写的16位CPU,本人也在学习中欢迎交流

2020-01-03 11:18:19 94KB CPU VHDL

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16位 CRC 校验代码

16位 CRC 校验代码直接可用

2020-01-03 11:16:49 20KB CRC

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label.png图像16位或24位转8位,用于Mask Rcnn训练(绝对可用)

(代码简洁, 绝对可用)使用python将24位或者16位图像转换为8位图像，用于labelme标记的MASK_RCNN进行样本训练, 自己的样本数据是24位就是用这代码进行转换成8位, 样本已训练成功.(16位亦可用).

2019-12-28 17:15:09 917B Mask Rcnn 16_to_8 24_to_8

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