JEDEC STANDARD DDR4 SDRAM JESD79-4B (Revision of JESD79-4A, November 2013) JUNE 2017
2019-12-21 19:54:02 4.85MB DDR4 JESD79-4B 最新规范
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这个是TQ2440群牛人总结出来的资料,讲解了程序从NandFlash启动,从nor flash启动,以及在sdram中运行有什么区别.
2019-12-21 19:48:14 27KB norflash启动 nandflash启动 sdram运行
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讲解 sdram 的工作原理,以及使用 verilog HDL 语言描述 sdram控制器,其中包括 sdram 的初始化、刷新、读和写。 FPGA 自带的内部存储空间非常的有限,当需要存储大量数据时,一般是借助于外围的存储设备, sdram 就是常用的存储设备之一,因为掌握 sdram 的内部工作原理,以及描述 sdram 控制器是 FPGA 工程师需要掌握的基本技能。
2019-12-21 19:47:03 642KB DDR3 SDRAM FPGA
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DDR2+SDRAM控制器的设计与验证,研究实现操作简便、带宽高的DDR2C设计方法。主要内容包括如何简化对DDR2 SDRAM的操作和最大限度的提高DDR2接口的带宽。
2019-12-21 19:42:49 2.47MB DDR2控制器
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AX301_学习教程之例程篇 01.Quartus下LED流水灯实验 02.Quartus下按键实验 03.Quartus下PLL实验 04.串口收发实验 05.数码管扫描实验 06.按键消抖实验 07.PWM蜂鸣器实验 07.附加_蜂鸣器播放音乐实验 08.spi_flash实验 09.ds1302数码管显示RTC时间实验 10.I2C接口EEPROM实验 11.sd卡读写实验 12.vga测试实验 13.sdram读写测试实验 14.录音与播放例程 15.SD卡音乐播放例程 16.字符显示实验 17.SD卡读取BMP图片显示例程 18.OV5640摄像头显示例程 19.彩色视频图像转黑白例程 20.SOBEL边缘检测例程 21.AD9226波形显示例程 22.AD7606波形显示例程 23.ADDA测试例程
2019-12-21 19:27:59 158.2MB AX301 FPGA VGA SDRAM
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基于verilog语言实现的SDRAM控制器设计(含源代码)
2019-12-21 19:24:04 4.14MB SDRAM控制器 verilog FPGA
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自己写的SDRAM控制器包括上电初始化,自刷新,读,写,仲裁五大模块,实际下板可用PLL相移已调试好
2019-12-21 19:21:37 47.58MB SDRAM控制器
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SDRAM的IP核VerilogHDL源代码,绝对可用
2019-12-21 19:21:15 27KB SDRAM IP核 Verilog HDL
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尽管ip核已经很成熟了,但是对于新手来说写一个SDRAM控制器能学到很多,小白可以借鉴一下,配套着了解一下,但是他的程序对于一个项目真要要实现来说,只是入门,不适合推荐使用。切记切记
2019-12-21 18:57:08 4.22MB sdram入门 开源骚客 小白学sdram
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