1 开发板简介  处理器架构先进:基于TI KeyStone C66x多核定点/浮点TMS320C6678 DSP,集成了8个C66x核,支持高性能信号处理应用;  运算能力强:每核心主频1.0G/1.25GHz,单核可高达40GMACS和20GFLOPS,每核心32KB L1P、32KB L1D、512KB L2,4MB多核共享内存,8192个多用途硬件队列,支持DMA传输;  网络性能优越:支持双千兆网口,带有由1个数据包加速器和1个安全加速器组成的网络协处理器;  拓展资源丰富:支持PCIe、SRIO、HyperLink、EMIF16等多种高速接口,同时支持I2C、SPI、UART等常见接口;  连接稳定可靠:80mm*58mm,体积极小的TMS320C6678核心板,采用工业级高速B2B连接器;  开发资料齐全:提供丰富的开发例程,入门简单,支持裸机和SYS/BIOS操作系统。
2022-03-14 23:19:36 2.17MB TMS320C6678
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2022-02-26 22:23:55 573KB 部分中文技术文档
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官方英文手册网址http://101.96.10.42/www.ti.com/lit/ug/sprugw0c/sprugw0c.pdf 本文档是对该手册的第九章多核DSP中断使用的中文翻译,翻译流畅准确,可放心使用。
2021-12-15 22:39:16 3.4MB 多核DSP C6678 tms320c667x tms320c6678
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TMS320C6678首先,论文阐述了图像压缩标准和图像压缩实现技术现状,从多种压缩标准和实现技术中选取 x264 开源代码加多核 DSP 模式实现 H.264 标准的图像压缩。其次,介绍了 TMS320C6678 的硬件结构、软件编程结构、核间通信模型、并行调度方案以及多核加载模式,为后面 x264 代码的并行与优化以及压缩平台上电自起奠定了基础。然后,对 H.264 图像压缩标准以及并行算法相关知识展开说明。从图片组、帧、片以及宏块四个层次对 H.264 的并行压缩编码技术进行了分析,通过对比选取 Slice 级为并行编码模型。最后结合 x264 开源代码特点在 TMS320C6678
2021-12-03 16:35:38 9.93MB TMS320C6678 h.264
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tms320c6678做了完整的分析和介绍,对于在tms320c6678上开发有很大的帮助。
2021-12-01 17:06:02 641KB tms320C6678 ccsv5
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基于EMIF接口的TMS320C6678多核程序自启动设计与实现,验证了可靠性。
2021-11-11 16:43:52 3.74MB TMS320C6678 多核DSP开发 设计与实现
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TMS320C6678是一款八核C66x的定点/浮点DSP,支持高性能信号处理应用。TMS320C6678芯片是美国德州仪器公司生产的处理器。它支持高性能信号处理应用,支持DMA传输,可应用于高端图像处理设备、雷达/声纳、软件无线电、高速数据采集和生成、机器视觉、信号分析仪、点钞机等等。
2021-11-10 11:28:59 25.83MB 创龙 6678 dsp
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TMS320C6678软件开发过程中,需要将.out文件经转换工具链转换为可以烧写到外部flash的.dat文件。本文档研究了该工具链的第一环节hex6x工具。
2021-11-07 21:16:04 2.91MB TMS320C6678 转换工具链 hex6x 格式转换
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文件中包含TMS320C6678的历程,经测试,文件都可以正常运行。里面包含EMIF_FPGA模块,GPIO模块,IIC模块,TIMER等模块。
2021-11-01 18:06:39 1.94MB dsp C6000 C TMS320C6678
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