使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
2019-12-21 18:56:33 823KB verilog VHDL 串口 并口
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vhdl写的rs232串口通信,很好用,已经测试通过
2019-12-21 18:49:23 707KB vhdl 串口
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