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UART收发模块源码(Vivado 2018.1+Xilinx/VHDL)
1.波特率可以灵活更改,默认115200Baud; 2.校验模式可以灵活更改,包括无校验、奇校验和偶校验,默认无校验; 3.代码注释详细,同时含有testbench仿真文件,用于测试闭环条件下的收发工作情况; 4.已经工作于实际工程应用中。
2022-03-31 21:49:56
73.25MB
uart
vhdl
fpga
串口通信
1
基于FPGA的串口通信
基于FPGA的串口通信 详细见微博:http://blog.csdn.net/jackinzhou/article/details/8047132
2022-03-31 17:18:26
462KB
FPGA
串口通信
RS232
1
基于FPGA的多串口通信设计与实现-论文
基于FPGA的多串口通信设计与实现
2022-03-29 14:12:44
1.06MB
基于
fpga
串口
通信设计
1
FPGA串口
接收模块及其仿真验证.rar
FPGA串口
接收模块及其仿真验证 内含串口接收模块、仿真用的testbench、时序图以及modelsim仿真工程
2022-03-27 21:39:02
222KB
verilog
UART
1
FPGA串口
通信程序 Verilog
XIlinx VerilogHDL实现串口通信程序,在Spand3的xc3s250e-4pq208芯片上实现了的。代码注释非常详细。绝对适合初学者。推荐使用ISE13.1及以上版本。
2022-03-14 10:24:15
2.43MB
FPGA
串口
1
FPGA串口
程序(VHDL)
采用VHDL语言编写的串口程序,通过测试,通信无误。
2022-03-03 15:33:36
71KB
串口
VHDL
1
FPGA串口
通信
FPGA,串口收发,时序仿真,Quartus+Synplify+ModelSim
2022-03-02 18:06:27
252KB
FPGA
串口
1
USB串口驱动,可以通过安装此驱动去实现
FPGA串口
的通信
USB串口驱动,可以通过安装此驱动去实现
FPGA串口
的通信
2022-01-27 14:06:22
18.86MB
fpga开发
1
UART_VGA_IMG.rar
altera fpga通过串口发送一张任意图片到DDR2中缓存,并通过VGA显示,自己测试完美显示,如果有问题可以联系我
2022-01-12 16:22:26
754KB
fpga
串口
vga
1
基于FPGA的串口帧数据通信实现.zip-综合文档
基于FPGA的串口帧数据通信实现.zip
2021-12-03 07:15:50
4KB
基于
fpga
串口
数据通信
1
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