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Verilog
硬件描述
语言
本书简要介绍了Verilog
硬件描述
语言的基础知识,包括语言的基本内容和基本结构 ,以及利用该语言在各种层次上对数字系统的建模方法。书中列举了大量实例,帮助读者掌握语言本身和建模方法,对实际数字系统设计也很有帮助。本书是Verilog HDL的初级读本,适用于作为计算机、电子、电气及自控等专业相关课程的教材,也可供有关的科研人员作为参考书
2022-11-03 23:49:01
4.55MB
Verilog
硬件描述语言
1
华为EM5800
硬件描述
华为全新一代OLT产品EM5800
硬件描述
。
2022-10-08 14:04:34
39.85MB
OLT-EA5800
1
华为 OSN 2500 智能光传输系统
硬件描述
V100R010
华为 OSN 2500 智能光传输系统
硬件描述
V100R010
2022-09-29 19:32:22
11.19MB
华为
OSN
2500
硬件描述
1
Verilog
硬件描述
语言IEEE官方手册
IEEE Standard Verilog Hardware Description Language IEEE_Verilog_2001
2022-08-31 22:50:53
4.33MB
fpga开发
1
二院型号FPGA
硬件描述
语言编程准则.pdf
中国航天科工集团第二研究院内部关于FPGA
硬件描述
语言编程准则, 包括:规范性引用文件;术语和缩写;一般要求;基本编程准则;RTL编程准则等等 主要描述的是VHDL及verilog语言的应用; 目的在于:大家共同学习、探讨关于语言的标准应用,不涉及商业应用的版权及商业的纠纷;
2022-08-03 07:21:42
574KB
航天二院FPGA标准
1
基于FPGA的进位保留Barrett模乘法器设计与实现
在有限域上的模算术运算中,乘法运算最基础且最耗时,因此为提高公钥密码体质的运算速度,设计出运算速度快、消耗时间少的模乘法器非常关键。该文设计出进位保留Barrett模乘法器,乘法部分利用进位保留乘法器,求模运算部分利用Barrett约减运算,用
硬件描述
语言进行FPGA设计与实现,避免了除法运算。对于192位的操作数,完成Barrett模乘需要约186个时钟周期,计算速率可以达到269.17 Mb/s。
2022-07-05 16:25:06
865KB
Barrett模约减;Barrett模乘法器;FPGA;硬件描述语言
1
数字电路软件实验:第四章
硬件描述
语言VHDL.ppt
数字电路软件实验:第四章
硬件描述
语言VHDL.ppt
2022-06-29 09:10:04
400KB
数字电路软件实验
数字电路:2 .逻辑代数与
硬件描述
语言基础.pdf
数字电路:2 .逻辑代数与
硬件描述
语言基础.pdf
2022-06-28 15:00:38
727KB
互联网
HUAWEI AntiDDoS8000 V500R005
硬件描述
HUAWEI AntiDDoS8000 V500R005
硬件描述
2022-06-24 19:05:55
50.22MB
华为
数字电子线路基础:第二章 逻辑代数与
硬件描述
语言基础.ppt
数字电子线路基础:第二章 逻辑代数与
硬件描述
语言基础.ppt
2022-06-17 09:00:55
2.9MB
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