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单bit信号跨时钟域工程1. 电平同步器 2. 边沿同步器 3. 脉冲检测器
单bit信号跨时钟域工程(verilog) 1. 电平同步器 2. 边沿同步器 3. 脉冲检测器 已经在vivado2019.1平台验证通过
2024-06-17 15:07:00
249KB
verilog
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VC6.0 MFC做的时钟
VC6.0 MFC做的时钟 可以调节时间 设置时间 界面上也可以设置
2024-06-12 17:36:01
1.89MB
1
计算机组成原理-logisim设计mips系统16位单时钟周期CPU设计
使用 Logisim 来创建一个16-位单时钟周期 CPU。 制作一个寄存器组(也称寄存器文件)模块(组件)。 制作一个 ALU,该 ALU 暂时可以仅实现 ADD,SUB,AND,OR 四种运算 制作一个下一条指令的逻辑,即 PC(程序计数寄存器)的逻辑 CPU 包括以下器件: 1)寄存器文件 2)PC 寄存器及每时钟周期 PC+1 的逻辑(需要认真阅读一下后面的说明) 3)ALU 4)指令内存(为了简单,建议你使用系统提供的 ROM,而不是 RAM)
2024-06-07 09:00:45
19KB
计算机组成原理
logisim
mips
cpu
1
基于51单片机的电子时钟-电路方案
通过lcd1602显示时间,可自由进行调控
2024-06-03 23:06:03
671KB
diy制作
电路方案
1
基于de1-SoC开发板设计的数字始终设计(Verilog HDL语言)
1、计时功能:包括对时间和日期的计时(秒、分、时、日、月、年)。 2、校时功能:能用按键方便地设置各时间单位计数初值(秒、分、时、日、月、年),当选择了某对象后,所对应的数码管闪烁点亮,以表示要对该对象初值进行设置。 3、清零功能:能用按键将时间清为0点0分0秒,或将日期清为00年01月01,或将闹钟定时设置清为0时0分0秒。 4、定时提醒(闹钟)功能:能在设定的时间,即灯持续亮,若按住任意一个按键,便可使灯灭。 5、整点报时功能:每逢正时,LED灯会亮5秒。 6、显示功能:同时采用6个数码管扫描显示时间、闹钟定时或倒计时的值。使用一个能进显示模式切换的按键,当按动不同的次数时,分别选择显示时间、闹钟定时时以及倒计时。 7、倒计时功能(具有启动/停止计算功能和按键清零功能,最大可计到(23时59分59秒)。
2024-06-03 20:09:04
7MB
Quartus
数字时钟设计
1
MFC图形时钟及电子时钟Clock
图形时钟和电子时钟同时实现,没有菜单栏和工具栏,外形简单,但时钟功能全部实现. 请多多指教,给点分吧,呵呵.
2024-06-03 15:24:35
3.33MB
MFC图形时钟+电子时钟
1
时钟芯片RX8025T的STM32驱动例程
时钟芯片RX8025T的STM32驱动例程,包括年月日时分秒的设置和读取,采用模拟IIC通讯
2024-06-03 15:06:16
6KB
stm32
IIC通讯
时钟芯片
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Axure RP9 制作动态时间、倒计时以及动态变化数字效果
1.动态时间可以放在原型的产品设计图上,使得预览效果更具系统的真实性; 2.动态数字可以自定义颜色和字体效果,放在大数据可视化大屏上,动态效果更加灵动; 3.
2024-06-01 21:21:47
143KB
axure
动态时钟
动态数字
1
TICS Pro 德州仪器 (TI) 时钟和合成器 (TICS) 专业软件
德州仪器 (TI) 时钟和合成器 (TICS) 专业软件
2024-05-30 10:21:30
79.35MB
elasticsearch
1
基于CPLD的数字时钟设计VHDL代码
课程设计中的基于CPLD的数字时钟VHDL代码:由于此课程设计主要以CPLD--EPM570T100C5N芯片为主,通过Quartus II编程软件进行编程,能实现以了时间24小时为一个周期的计时和显示(时,分,秒共6个数码管显示);本设计还拓展了闹钟模块和秒表模块。有校时功能,可以分别对时,分,秒的值单独校时,使其校正到标准时间(即可以对时间进行预值);计时过程具有报时功能,当时间到达整点进行5S蜂鸣或指示灯亮报时。在各种模块中的操作不会影响其他两个模块。
2024-05-26 00:22:54
27KB
VHDL
CPLD
数字时钟
1
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