MB1504设计环路滤波器是不方便,这个好用的环路滤波器设计软件可以帮你!

分数分频锁相环中使用的SDM的基础理论分析和simulink建模，有Mash 111结构，和三阶四阶单环结构，参考了很多篇文献，数据结果用matlab仿真过，确认没有问题

锁相环作为现代时钟电路的重要组成部分，已经成为超大规模集成电路中必不可少的一个模块，几乎所有的数字集成电路中都采用锁相时钟产生电路来提供片内高速时钟。随着SoC技术的出现，作为IP建库的重要内容，对锁相环电路的研究和设计也具有了更加重要的意义。 本文首先简要介绍了锁相技术的历史和发展，及其现状与研究方向。第二章中对锁相环的原理和各种特性进行了详细的介绍，主要包括相位/频率响应、稳定性和噪声特性等方面的分析。第三章给出了各种典型的锁相环子模块电路和系统结构，重点介绍了鉴频鉴相器、电荷泵和压控振荡器这三个主要模块。第四章中，提出了几种新型锁相环子模块电路结构，包括改进的双边鉴频鉴相器、新型电流型压控振荡器和新型延迟锁环频率合成电路，同时分别对它们的性能进行了分析，并将之与典型电路结构加以比较。最后，对整个锁相环的设计和研究进行了总结。 本文设计的锁相频率合成器采用上海贝岭1.2μm CMOS工艺实现，完成了全部电路的设计、仿真及版图的设计，并通过了版图提取和后仿真。 关键词：锁相环、时钟产生、频率合成、鉴频鉴相器、电荷泵、压控振荡器、相位噪声、延迟锁环

可将输入信号进行90度移相，用锁相环实现，可用于信号处理

杜勇老师编著的 的全部源码例程.

FPGA自学5——PLL锁相环 生成测试代码

缺省了40页，但是这个也是不容易找到的。共享一下。这个是看了不少书感觉最详细的一本。

锁相技术课后习题答案 (张厥盛-郑继禹-万心平版)_西安电子科技大学出版社.pdf )

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袁雷书上缺失PLL的仿真，这里补上。本simulink仿真（已经转为MATLAB2016a文件）是在传统SMO+反正切函数的大框架下对反正切函数进行PLL的替换，主框架保持不变（仍然采用continue仿真）。同时把PMSM模型改成Aligned with phase A axis,这样把输出位置减pi/2去掉，以便为后面实验验证打下基础。