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基于FPGA试验箱的lcd1602液晶显示程序
本实验为用lcd1602显示0到9之间顺序变化,考虑到状态较多,可通过case语句,每一句对应一个数字,从而实现在lcd1602上的显示。
2019-12-21 19:24:05
3KB
verilog
FPGA
VHDL
1
基于verilog语言实现的SDRAM控制器设计(含源代码)
基于verilog语言实现的SDRAM控制器设计(含源代码)
2019-12-21 19:24:04
4.14MB
SDRAM控制器
verilog
FPGA
1
基于FPGA的GMSK调制模块的设计与实现
本资源只提供“基于FPGA的GMSK调制模块的设计与实现”Verilog设计源代码
2019-12-21 18:58:29
8KB
GMSK调制
verilog
FPGA
1
FPGA数字信号处理(二)并行FIR滤波器Verilog设计
并行结构FIR滤波器的Verilog HDL代码,Vivado工程,含testbench与仿真,仿真结果优秀
2019-12-21 18:49:39
4.35MB
Verilog
FPGA
Vivado
FIR
1
ca码生成(verilog)
用verilog写的一个ca码的生成代码,内含quartusII的仿真文件(波形和testbench)。
2014-05-13 00:00:00
3KB
CA码
verilog
fpga
quartusII
1
verilog那些事儿V3.0
写的非常不错的入门级教程,详细的实例,可以很快入门!推荐推荐!
2011-03-17 00:00:00
17.81MB
verilog,fpga,黑金
1
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