4*4的华莱士树乘法器实现了直接处理带符号数乘法
2020-01-04 03:14:51 5KB Hspice 乘法器
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乘法器的设计思想,其实就是把乘法还原成加法来实现。注意一点,就是进入乘法器的数据和结果数据,要在正确的时间提取。乘法不能过快,要慢于计算周期。简单除法的思想,就是将除法,还原为减法的过程。
2020-01-03 11:29:35 304KB FPGA Verilo 串行乘法器 简单除法器
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模拟乘法器,完成调幅解调,分频混频功能 进行电路设计、并用EWB,multisim或Pspice 或ADS软件进行电路仿真和电路调试。至少实现如下功能: a) 单音普通调幅波,调制度可调;双边带调幅波。 b) 混频功能 c) 二倍频。 d) 自行设计其他功能
2020-01-03 11:16:42 262KB 模拟乘法器 调幅解调
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这三篇文章都对CSD乘法器做了相关介绍,同时也给出了基于FPGA的实现方法。
2019-12-28 17:24:32 538KB CSD 乘法器 FPGA
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Verilog 4位乘法器设计实现4位二进制数的乘法运算
2019-12-21 22:25:31 655B 乘法器
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用ModelSim实现了Altera 乘法器IP核的仿真,有利于初学者学习
2019-12-21 22:19:17 12.15MB Altera 乘法器 IP核 Modelsim
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定点补码一位乘法器的设计 计算机组成原理课程设计 可硬件下载
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不错的乘法器代码library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; use ieee.std_logic_arith.all;
2019-12-21 22:13:20 1KB VHDL16位乘法器
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Verilog四位乘法器实验报告带有仿真图
2019-12-21 22:11:43 44KB 乘法器
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计算机组成原理课程设计-阵列乘法器设计与实现 带报告与代码
2019-12-21 22:09:09 1.27MB 计算机 组成原理 课程设计 阵列乘法器
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