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基于VHDL的数字时钟设计
这是vhdl设计数字时钟设计,包括如何除去抖动,怎样去设计时钟等等
2021-09-07 19:22:39
7.19MB
vhdl
数字时钟
1
16个数字时钟数字电子钟仿真电路图multisim仿真源文件合集,multisim10以上版本可打开运行.zip
16个数字时钟数字电子钟仿真电路图multisim仿真源文件合集,multisim10以上版本可打开运行: 数字时钟X.ms10 数字电子钟.ms10 数字电子钟仿真电路图.ms10 数字电子钟仿真电路图2.ms10 数字电子钟仿真电路图2XX.ms10 数字电子钟仿真电路图3.ms10 数字电子钟(部分).ms10 数字钟(74LS192).ms12 数字钟12进制小时显示.ms12 数字钟X.ms10 数字钟报时.ms10 数字钟报时2.ms10 数字钟报时X.ms10 数字钟整点报时.ms10 数字钟(74LS160计数,555频率1KHz,74LS90分频).ms12 数字闹钟.ms12
2021-09-01 21:03:58
6.28MB
数字时钟
数字电子钟仿真电路图
multisim仿真源文件
数字闹钟.ms12
多功能数字时钟设计资料全套设计及说明材料.zip
多功能数字时钟设计资料全套设计及说明材料
2021-08-07 14:05:42
302KB
数字时钟
单片机数字时钟资料全套设计及说明材料.zip
单片机数字时钟资料全套设计及说明材料
2021-08-07 11:01:49
163KB
时钟
如何使用51单片机实现数字时钟仿真设计(包含原理图仿真文件)#资源达人分享计划#
如何使用51单片机实现数字时钟仿真设计,包含原理图仿真文件
2021-08-06 10:09:37
28KB
单片机
时钟信号抖动模拟:此功能创建用户可定义的数字时钟信号,您可以向其中添加随机抖动。-matlab开发
此功能创建一个用户可定义的数字时钟信号波形,上面带有随机抖动。 此功能可用于生成可上传到任意波形发生器 (AWG) 的波形数据,以模拟具有已知抖动量的真实数字时钟,用于抗扰度和其他类似测试应用。 随机抖动是使用 matlab 的 rand 函数生成的。 您可以选择两种不同的分布来生成随机值:正态分布和均匀分布。 对于正态分布抖动幅度变量用作覆盖分布区域 99.7% 的 3 西格玛点。 该函数使用 Matlab 的内置误差函数或 erf() 函数。 有关信息erf() 函数http://www.mathworks.com/help/techdoc/ref/erf.html 。 有关此函数中用于模拟真实世界抖动的技术和数学的更多信息或问题,请参阅我的博客文章: http://gpete-neil.blogspot.com/2011/08/simulating-jitter-with-arbit
2021-08-05 21:18:53
3KB
matlab
1
EDA数字时钟.zip
包含程序和课程设计报告 (1)基本要求:最大为 1 小时,精度要求为 0.01 秒,具有开始/暂停和清零功能,要求 能在数码管上面正确显示。 (2)在完成基本要求的基础上,可进一步增加功能(如能够存储多个数据并能够回查)、提 高性能。
2021-08-04 13:02:48
10.55MB
EDA
1
vb.net科幻桌面源码
,数字时钟
+天气+蜂巢等元素桌面
不可多得的桌面源码,主要具有以下功能: 1.数字时钟,2.天气桌面,3.蜂巢等元素桌面。4.科幻桌面 压缩包文件5M,源码里包括n个非常好的类及模块,非常值得学习,记得打好评哦,这可是压仓底的宝贝源码。
2021-07-28 22:39:32
5.1MB
vb.net
桌面
科幻桌面
1
【数字系统/Verilog/Quartus】时分可调的LCD数字时钟显示(内含模块:LCD显示静态字符串/60、24进制计数器).rar
工程实现:在LCD液晶显示屏上显示数字时钟,自动按秒计时,可由用户通过按键控制时钟暂停,并设置时、分的值。 程序使用Verilog HDL语言,编译、仿真、下载工具使用Quartus II。 经测试,工程可成功下载到开发板上并运行。相关博文见主页。
2021-07-23 14:03:07
420KB
fpga/cpld
verilog
芯片
硬件开发
1
数字时钟设计
采用电子线路的数字时钟的设计方案。使用74ls04,74ls20,74ls00,74ls 48,74ls160,八段数码管,ne555,晶振,等原件制成。附电路原理图以及pcb图
2021-07-20 17:02:21
2.75MB
数字时钟
电子线路
1
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