同步是通信系统中一个重要的问题。在数字通信中，除了获取相干载波的载波同步外，位同步的提取是更为重要的一个环节。因为只有确定了每一个码元的起始时刻，才能对数字信息作出正确的判决。利用全数字锁相环可直接从接收到的单极性不归零码中提取位同步信号。

本设计是一个基于Altera Cycone Ⅳ系列的FPGA芯片实现一个37阶FIR数字滤波器，其中采样频率为13.5MHz，截止频率0.23MHz，窗口函数采用海明窗，算法为分布式算法。包含源程序及仿真文件，程序可直接用于板间调试

基于基于FPGA的人脸检测系统设计的人脸检测系统设计选取一种由粗及精的方法，综合采用基于彩色图像的肤色检测方法和基于几何特征的灰度检测方法，在传统肤色检测算法的

阐述了灰度形态学滤波的原理和基本操作,给出了3×3结构元素灰度形态学滤波器的硬件结构,详细描述了该滤波器在Xilinx公司的XC2S400E芯片上实现的过程和仿真的方法,并说明了需要注意的问题。

针对模拟或基于DSP的磁悬浮轴承控制器和功率放大器，具有集成度和可靠性低及体积庞大的局限性，设计了一种基于现场可编程门阵列(FPGA)的磁悬浮轴承电控系统．首先应用MAT-LAB对各部分进行了建模，然后针对各部分参数对其性能的影响进行了仿真研究，最后对基于FPGA的数字功率放大器的纹波与动态特性进行了试验，并将它们应用到磁悬浮球系统中实现了悬‘浮球的稳定悬浮．结果表明：该数字控制器使磁悬浮球悬浮时的振动量控制在15μm；设计的数字功率放大器在母线电压为150 V，开关频率为25 kHz，负载线圈电感为40

内涵word和ppt

内部包含word和ppt文档并且里面还包含了各种模块的代码。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

介绍一种基于FPGA（Field Programmable Gate Array）现场可编程门阵列的可键盘控制的计数，显示电路的实现方法。应用VHDL语言（高速集成电路硬件描述语言）完成了3×4矩阵开关的扫描电路，可预置数的BCD码计数电路及4位数码管动态扫描电路的描述。通过原理图输入方式完成了系统功能的设计。电路结构简单，便于扩展，可靠性高，且可移植性强，容易实现。该电路已成功应用于测试某脉冲电容质量试验的控制电路中。

为解决雷达探测能力与距离分辨力之间的问题，在线性调频信号脉冲压缩的原理的基础上，利用MATLAB软件对数字脉冲压缩算法进行仿真，给出一种基于FPGA分布式算法的时域脉冲压缩实现结构，利用图形编辑和VHDL硬件描述语言混合编程，完成脉冲压缩处理各模块设计以及波形仿真。利用基于分布式算法大大减少数字脉冲压缩的运算量，提高脉冲压缩的效率。

FPGA中的FFT核可以用来实现频域算法中所需的FFT和IFFT，其点数是相对固定的，经过FFT(IFFT)处理的延时也是相对固定的，受制于FFT(IFFT)的运算点数，常规算法需要舍弃一段雷达探测距离，同时大点数的FFT(IFFT)运算有很大的处理延时；一般雷达回波信号的长度远远大于发射的脉冲信号长度，基于等效快速卷积的频域算法的优势难以表现，对距离接收窗内的回波进行分段，再通过重叠相加法实现完整回波的脉冲压缩可以通过小点数的脉冲压缩来实现全点数的脉冲压缩；