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单周期CPU实现(
verilog语言
,使用vivado软件)
这是计算机组成原理课设,基于verilog实现的单周期CPU代码,实现了add, addu, addi, addiu, sub, slt, and, or, xor, beq, j, sw, lw, lui,andi,addu,ori,xori,共18条指令,能够运行简单的冒泡排序。内含实验报告。
2021-05-27 22:02:39
717KB
verilog
单周期CPU
冒泡排序
计算机组成原理
Verilog 语言实现2倍频程序
简单的verilog程序,实现输出信号为输入信号的2倍频。
2021-05-24 11:32:09
280B
CPLD
Verilog
倍频
1
XHDL之VHDL与
Verilog语言
互相转化
完美支持FPGA编写的vhdl语言与
Verilog语言
之间的互相转化,便于初学者同时掌握两种语言,以及更好地学习FPGA
2021-05-16 12:46:28
19.25MB
vhdl_Verilog
1
计算机组成原理——
Verilog语言
实现的32位并行加法器
用并行方法实现的加法器,比一般的串行方法更加高效。
Verilog语言
实现。
2021-05-16 00:04:13
52KB
加法器
并行
1
CRC校验,FPGA
Verilog语言
实现,16位
简单的CRC,16位校验,FPGA实现
2021-05-15 18:02:49
2KB
FPGA
Verilog
1
verilog语言
的FPGA数字锁相环PLL实现
使用
verilog语言
实现的FPGA数字锁相环(pll)
2021-05-14 15:16:26
198KB
verilog
fpga
pll
1
用
Verilog语言
写的CPLD和MCU通讯的SPI接口程序.rar
用
Verilog语言
写的CPLD和MCU通讯的SPI接口程序.rar用
Verilog语言
写的CPLD和MCU通讯的SPI接口程序.rar用
Verilog语言
写的CPLD和MCU通讯的SPI接口程序.rar
2021-05-08 19:09:36
108KB
用Verilog语言写的CPLD和MCU通讯的SPI接口程序.rar
1
用Verilog 语言实现alu的设计.rar
用Verilog 语言实现alu的设计 用Verilog 语言实现alu的设计
2021-05-06 20:10:15
666B
Verilog
1
基于FPGA的I2C协议实现(内有源代码)I2C_pro.rar
通过verilog编写语言实现读写操作i2c芯片,经过验证可用,能够实现任意地址的读写数据操作,里面有modelsim仿真工程可自行测试。
2021-04-30 00:10:31
125KB
FPGA
硬件
verilog语言
modelsim仿真
1
ca_cfar
verilog语言
,定点
ca_cfar
verilog语言
版本 定点算法,算法参数均可以根据自己需求进行设置,已验证,适用于初级目标检测算法学习
2021-04-26 10:43:54
6KB
ca_cfar
verilog
定点
1
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