This project is intended to help you to understand the cache architecture and its mechanism. In this project, you will design a first-level data cache controller with Verilog HDL step by step. You may need to review the knowledge about the language to make sure you can finish the project smoothly.

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计算机组成与设计：软硬件接口技术配套资料，测试题答案

中南大学2010级计算机系大三下学期汇编语言和计算机组成原理课程设计，详细汇编代码，详细报告。

选定指令格式、操作码，设计如下指令： （1） 把用绝对地址表示的内存单元A中的内容与内存单元B中的内容相加，结果存于内存单元C中。 指令格式：D4××，ADDR1，ADDR2，ADDR3 四字指令（控存入口100H） 功能： [ADDR3]=[ADDR1]+[ADDR2] （2） 将一通用寄存器内容减去某内存单元内容，结果放在另一寄存器中。 指令格式：E0 DR SR，ADDR （SR，DR源、目的寄存器各4位）双字指令（控存入口130H） 功能： DR=SR - [ADDR] （3） 转移指令。判断两个通用寄存器内容是否相等，若相等则转移到指定绝对地址，否则顺序执行。 指令格式：E5 DR SR，ADDR 双字指令（控存入口140H） 功能： if DR==SR goto ADDR else　顺序执行。 设计：利用指令的CND字段，即IR10~8，令IR10~8=101，即CC=Z 则当DR==SR时Z=1，微程序不跳转，接着执行MEM PC（即ADDR PC） 而当DR!=SR时Z=0，微程序跳转至A4。

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计算机组成与设计 硬件软件接口习题答案原书第五版，王党辉等翻译

《计算机组成与设计：硬件/软件接口（原书第5版）》是计算机组成与设计的经典畅销教材，第5版经过全面更新，关注后PC时代发生在计算机体系结构领域的革命性变革——从单核处理器到多核微处理器，从串行到并行。本书特别关注移动计算和云计算，通过平板电脑、云体系结构以及ARM（移动计算设备）和x86（云计算）体系结构来探索和揭示这场技术变革。 　　与前几版一样，本书采用MIPS处理器讲解计算机硬件技术、汇编语言、计算机算术、流水线、存储器层次结构以及I/O等基本功能。 　　《计算机组成与设计：硬件/软件接口（原书第5版）》特点 　　更新例题、练习题和参考资料，重点关注移动计算和云计算这两个新领域。 　　涵盖从串行计算到并行计算的革命性变革，第6章专门介绍并行处理器，每章中都涉及并行硬件和软件的相关主题。 　　全书采用Intel Core i7、ARM Cortex-A8和NVIDIA Fermi GPU作为实例。 　　增加“运行更快”这一新实例，说明正确理解硬件技术的重要性，它能使软件性能提高200倍。 　　讨论并强调计算机体系结构的“8个伟大思想”——通过并行提高性能、通过流水线提高性能、通过预测提高性能、面向摩尔定律的设计、存储器层次、使用抽象简化设计、加速大概率事件和通过冗余提高可靠性。

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