利用随机函数产生N个随机整数(20000以上),对这些数进行多种方法进行排序。 要求: 1) 至少采用五种方法实现上述问题求解(提示,可采用的方法有插入排序、希尔排序、起泡排序、快速排序、选择排序、堆排序、归并排序)。并把排序后的结果保存在不同的文件中。 2) 统计每一种排序方法的性能(以上机运行程序所花费的时间为准进行对比),找出其中两种较快的方法。
2023-12-05 22:19:49 15.88MB 数据结构课设
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电子科技大学研一《机器学习》考试重点笔记,课程内容和笔记内容参考周志华西瓜书,可以私信发ppt
2023-11-25 21:30:45 112.5MB 机器学习 电子科技大学 复习重点
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1.时钟输入采用实验箱的1Hz信号(在电源开关下面),分别测试两片74x161的逻辑功能。由于数码管不能显示A-F,所以用LED灯显示计数器的输出状态。 2.将两片74x161进行级联,实现模256计数器,用LED灯显示计数器的输出状态。 3.用两片74x161分别实现模6和模10计数器,用数码管显示计数器的输出状态。再将两片74x161进行级联,实现模60计数器,用数码管显示计数器的输出状态。 4.拓展题:任选一个设计下列十进制计数器:模24、模28、模29、模30、模31、模100。
2023-11-23 15:24:17 1.5MB verilog fpga 数字逻辑
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1.3-8译码器的设计和实现。 2.4位并行进位加法器的设计和实现。 3.两输入4位多路选择器的设计和实现。 4.拓展:3输入多数表决器设计和实现。 实验要求如下: 1.采用Verilog语言设计,使用门级方式进行描述。 2.编写仿真测试代码。 3.编写约束文件,使输入、输出信号与开发板的引脚对应。 4.下载到FPGA开发板,拨动输入开关,观察Led灯的显示是否符合真值表。
2023-11-23 15:23:33 1.85MB Verilog FPGA 数字逻辑
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1.逻辑输入采用实验箱的K1-K11,逻辑输出接L1-L10。测试实验箱上的HD74LS04P(非门)、SN74LS32N(或门)、SN74LS00N(与非门)、SN74HC86N(异或门)、SN74HC153(数据选择器、多路复用器)的逻辑功能。 2.采用小规模逻辑器件设计一位数据比较器:设一位数据比较器的输入为A、B,比较A>B,A=B,A
2023-11-23 15:15:10 1.84MB 数字逻辑 Verilog
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1.作业名称:工厂模式 2.作业内容: 制作一个抽象产品: 杯子 ① 制作2个具体产品: 250ml杯子和500ml杯子使用简单工厂来实现这个场景,并且让客户端通过简单工厂来获取具体产品。 ② 然后扩展-一个750ml杯子,你会发现这要修改简单工厂的代码。_进而就违反 了开闭原则。 ③ 所以再使用工厂方法来重构一遍代码。保证750ml杯子可以被顺利地扩展进来。 ④ 最后还需要为杯子成产相应的杯盖,杯盖随杯子容积的大小而不同,请继续重构完成该扩展。
2023-11-15 19:57:07 698KB
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30款2.5d互联网科技UI素材,可以编辑替换,AI PS 均可打开 2.5d插画30款2.5d互联网科技UI素材,可以编辑替换,AI PS 均可打开 2.5d插画
2023-11-12 15:41:45 18.4MB
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2023-11-04 18:24:03 14.5MB
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2023-10-18 08:03:15 235KB 达内科技 c++ 课件
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