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32位浮点
正余弦函数的pfga实现
32位浮点
正余弦函数的pfga实现,好不容易找到的资料
2022-10-10 14:27:24
465KB
32位浮点正余弦函数的pfga实现
1
S7-200SMART 64位浮点数转
32位浮点
数(源文件+库文件+程序注释).rar
S7-200SMART 64位浮点数转
32位浮点
数(源文件+库文件+程序注释),double to float
2022-01-12 19:04:09
203KB
S7-200SMART
64位浮点数转32位浮点数
源文件+库文件
程序注释
基于CORDIC算法的
32位浮点
三角超越函数之正余弦函数的FPGA实现
基于CORDIC算法的
32位浮点
三角超越函数之正余弦函数的FPGA实现!本人已编程实现!
2021-12-28 01:39:51
223KB
CORDIC算法
浮点
三角
函数
1
32位浮点
平台G723.1语音编解码代码
ITU-T G723.1标准语音编解码代码
2021-12-09 14:50:08
13.64MB
语音编解码
G723.1
32位浮点
1
S7-200SMART 64位浮点数转换为
32位浮点
数指令库文件Double_to_Float.rar
S7-200SMART 64位浮点数转换为
32位浮点
数指令库文件Double_to_Float
2021-11-22 10:01:55
3KB
S7-200SMART
64位浮点数转换为32位浮点数
指令库文件
Double_to_Float
IEEE754标准的
32位浮点
数格式
在C语言中float类型在数据输出是可能由于精度原因导致出错,所以可以参考本标准。 ,
2021-10-18 01:45:48
243KB
浮点数
输入标准
1
32位浮点
数加法器_system verilog.zip
32位浮点
数加法器基于system verilog,可以实现串行输入的两个标准化的
32位浮点
数的相加并得到标准化的结果。此外该加法器能处理“特殊”数字:零、正无穷、负无穷和“非数字(NaN)”。本文件带测试代码
2021-08-07 14:06:25
3KB
verilog
浮点数加法器
systemverilog
1
IEEE标准的
32位浮点
数转换为十进制的计算方法
工作中碰到的一个小问题,经过了一番研究,终于搞明白了,为了以后大家不再挠头,写了这个供大家参考。其中涉及到MODTEST 软件 MODBUS协议 IEEE32位二进制浮点数与十进制小数转换的方法等内容。
2021-08-04 13:30:28
39KB
IEEE标准
32位浮点数
十进制
进制转换
1
C# IEEE754转换
32位浮点
数为10进制数 电力仪表RS485专用
C# IEEE754转换
32位浮点
数为10进制数 电力仪表RS485专用
2021-07-12 14:17:58
1KB
IEEE754转换
32位浮点数
RS485
电力仪表
1
32位浮点
加法器源代码
32位浮点
加法器VHDL源代码部分,双精度
2021-04-05 18:14:50
18KB
32位
浮点加法器
代码
1
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